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參數(shù)資料
| 型號： | DS3160 |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 70/107頁 |
| 文件大小： | 592K |
| 代理商： | DS3160 |
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DS3160
70 of 107
Register Name:
Register Description:
Register Address:
BERTEC1
BERT 24-Bit Error Counter (upper)
30h
Bit #
Name
Default
7
6
5
4
3
2
1
0
BEC15
0
BEC14
0
BEC13
0
BEC12
0
BEC11
0
BEC10
0
BEC9
0
BEC8
0
Bit #
Name
Default
15
14
13
12
11
10
9
8
BEC23
0
BEC22
0
BEC21
0
BEC20
0
BEC19
0
BEC18
0
BEC17
0
BEC16
0
Note:
Bits that are underlined are read-only; all other bits are read-write.
Bits 0 to 15/BERT 24-Bit Error Counter (BEC8 to BEC23).
Upper two bytes of the 24-bit counter.
This 24-bit counter increments for each data bit received in error. This counter is not disabled when the
receive BERT loses synchronization; it can be cleared by toggling the LC control bit in BERTC0. This
counter saturates and does not rollover. Upon saturation, the BECO status bit in the BERTEC0 register is
set. This error counter starts counting when the BERT goes into receive synchronization (RLOS = 0 or
SYNC = 1) and it does not stop counting when the BERT loses synchronization. It is recommended that
the host toggle the LC bit in BERTC0 register once the BERT has synchronized and then toggle the LC
bit again when the error-checking period is complete. If the device loses synchronization during this
period, then the counting results are suspect.
As stated in the LC bit description section, the LC bit must be toggled from low to high to begin an
update cycle. This update cycle has a latency of three clock periods from the setting of the LC bit from (0)
to (1). Therefore, each read by the host requires a 475ns period (158.43ns x 3 clocks) to retrieve data from
the BERT error count registers.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS3171 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3171N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3172 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3172N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3173 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DS3161 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Sgl ATM/Packet PHYs for DS3/E3/STS-1 RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS31612 | 制造商:Maxim Integrated Products 功能描述:12 PORT ATM/PHY 676-TEPBGA - Trays |
| DS31612N | 制造商:Maxim Integrated Products 功能描述:12 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS3161N | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Sgl ATM/Packet PHYs for DS3/E3/STS-1 RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3162 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Dual ATM/Packet PHYs for DS3/E3/STS-1 RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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