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參數資料
| 型號： | DS3160 |
| 元件分類： | 通信及網絡 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數： | 61/107頁 |
| 文件大?。?/td> | 592K |
| 代理商： | DS3160 |
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DS3160
61 of 107
6. BERT
6.1 General Description
The BERT block is capable of generating and detecting the following patterns:
the pseudorandom patterns 2
7
- 1, 2
11
- 1, 2
15
- 1, and QRSS
a repetitive pattern from 1 to 32 bits in length
alternating (16-bit) words that flip every 1 to 256 words
The BERT receiver has a 32-bit bit counter and a 24-bit error counter. It can generate interrupts on
detecting a bit error, a change in synchronization, or if an overflow occurs in the bit and error counters.
See Section 6.2 for details on status bits and interrupts from the BERT block. To activate the BERT
block, the host must configure the BERT mux by the BERT mux control register (Section 6.2).
6.2 BERT Register Description
Register Name:
Register Description:
Register Address:
BERTMC
BERT Mux Control Register
20h
Bit #
Name
Default
7
6
5
4
3
2
1
0
N/A
0
N/A
0
N/A
0
N/A
0
TBS1
0
TBS0
0
RBS1
0
RBS0
0
Bit #
Name
Default
15
N/A
0
14
N/A
0
13
N/A
0
12
N/A
0
11
N/A
0
10
N/A
0
9
8
N/A
0
N/A
0
Note:
Bits that are underlined are read-only; all other bits are read-write.
Bits 0 to 1/Receive BERT Select Bits 0 to 1 (RBS0 to RBS1).
These bits enable/disable the BERT
receiver and select how BERT data is sent to the receiver (active timeslot bits only or active timeslot and
the overhead bits).
RBSI
0
RBS0
0
DESCRIPTION
Disabled
Active Timeslots Only
6Mbps: TS1–TS96
4.5Mbps: TS1–TS72
3Mbps: TS1–TS48
1.5Mbps: TS1–TS24
Entire Frame including F-Bits (all 789 bits)
Illegal State
0
1
1
1
0
1
相關PDF資料 |
PDF描述 |
|---|---|
| DS3171 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3171N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3172 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3172N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3173 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
相關代理商/技術參數 |
參數描述 |
|---|---|
| DS3161 | 功能描述:網絡控制器與處理器 IC Sgl ATM/Packet PHYs for DS3/E3/STS-1 RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS31612 | 制造商:Maxim Integrated Products 功能描述:12 PORT ATM/PHY 676-TEPBGA - Trays |
| DS31612N | 制造商:Maxim Integrated Products 功能描述:12 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS3161N | 功能描述:網絡控制器與處理器 IC Sgl ATM/Packet PHYs for DS3/E3/STS-1 RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3162 | 功能描述:網絡控制器與處理器 IC Dual ATM/Packet PHYs for DS3/E3/STS-1 RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數量: 數據速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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