參數(shù)資料
型號： DS21FT42
元件分類： 通信及網(wǎng)絡
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數(shù)： 37/145頁
文件大?。?/td> 466K
代理商： DS21FT42
DALLAS SEMICONDUCTOR
DS21FF42/DS21FT42
101899
/1237
NOTE: For a description of how the bits in TCR1 affect the transmit side formatter, see Figure 24-15.
TCR2: TRANSMIT CONTROL REGISTER 2
(Address=36 Hex)
(MSB)
TEST1
(LSB)
TB7ZS
TEST0
TZBTSI
TSDW
TSM
TSIO
TD4YM
SYMBOL
POSITION
NAME AND DESCRIPTION
TEST1
TEST0
TZBTSI
TCR2.7
TCR2.6
TCR2.5
Test Mode Bit 1 for Output Pins.
See Table 10–1.
Test Mode Bit 0 for Output Pins.
See Table 10–1.
Transmit Side ZBTSI Enable.
0 = ZBTSI disabled
1 = ZBTSI enabled
TSYNC Double–Wide.
(note: this bit must be set to zero when
TCR2.3=1 or when TCR2.2=0)
0 = do not pulse double–wide in signaling frames
1 = do pulse double–wide in signaling frames
TSYNC Mode Select.
0 = frame mode (see the timing in Section 24)
1 = multiframe mode (see the timing in Section 24)
TSYNC I/O Select.
0 = TSYNC is an input
1 = TSYNC is an output
Transmit Side D4 Yellow Alarm Select.
0 = zeros in bit 2 of all channels
1 = a one in the S–bit position of frame 12
Transmit Side Bit 7 Zero Suppression Enable.
0 = no stuffing occurs
1 = Bit 7 force to a one in channels with all zeros
TSDW
TCR2.4
TSM
TCR2.3
TSIO
TCR2.2
TD4YM
TCR2.1
TB7ZS
TCR2.0
OUTPUT PIN TEST MODES
Table 10-1
TEST 1
TEST 0
EFFECT ON OUTPUT PINS
0
0
0
1
operate normally
force all of the selected framer’s output pins 3–state (excludes other
framers I/O pins and parallel port pins)
force all of the selected framer’s output pins low (excludes other
framers I/O pins and parallel port pins)
force all of the selected framer’s output pins high (excludes other
framers I/O pins and parallel port pins)
1
0
1
1
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