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參數(shù)資料
| 型號： | AK5700VN |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 英文描述： | 16-Bit ツヒ Mono ADC with PLL & MIC-AMP |
| 中文描述： | 16位ツヒ單聲道ADC，帶鎖相環(huán) |
| 文件頁數(shù)： | 57/61頁 |
| 文件大小： | 519K |
| 代理商： | AK5700VN |
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ASAHI KASEI
[AK5700]
MS0569-E-01
2006/12
- 57 -
Stop of Clock
Master clock can be stopped when ADC is not used.
1. PLL Master Mode
External MCKI
PMPLL bit
(Addr:11H, D0)
MCKO bit
(Addr:16H, D2)
Input
(3)
(1)
(2)
"H" or "L"
M/S bit
(Addr:11H, D1)
Example:
Audio I/F Format: I2S
BCLK frequency at Master Mode: 64fs
Input Master Clock Select at PLL Mode: 11.2896MHz
Sampling Frequency: 44.1kHz
(2) Addr:16H, Data:00H
(1) Addr:11H, Data:10H
(3) Stop an external MCKI
Figure 49. Clock Stopping Sequence (1)
<Example>
(1) Power down PLL: PMPLL=M/S bits = “1”
→
“0”
(2) Stop MCKO clock: MCKO bit = “1”
→
“0”
(3) Stop an external master clock.
2. PLL Slave Mode (EXLRCK, EXBCLK pin)
EXBCLK
PMPLL bit
(Addr:11H, D0)
Input
(1)
(2)
EXLRCK
Input
(2)
Example
Audio I/F Format : I2S
PLL Reference clock: EXBCLK
BCLK frequency: 64fs
Sampling Frequency: 44.1kHz
(1) Addr:11H, Data:0CH
(2) Stop the external clocks
Figure 50. Clock Stopping Sequence (2)
<Example>
(1) Power down PLL: PMPLL bit = “1”
→
“0”
(2) Stop the external EXBCLK and EXLRCK clocks
* Clock stop sequence is the same for Slave&Bypass Mode.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AK5701KN | 16-Bit ツヒ Stereo ADC with PLL & MIC-AMP |
| AK5701_07 | 16-Bit ツヒ Stereo ADC with PLL & MIC-AMP |
| AK5701VN | 16-Bit ツヒ Stereo ADC with PLL & MIC-AMP |
| AK5701 | digital audio 16bit A/D converter |
| AK5702 | 4-Channel ADC with PLL & MIC-AMP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AK5701 | 制造商:AKM 制造商全稱:AKM 功能描述:digital audio 16bit A/D converter |
| AK5701_07 | 制造商:AKM 制造商全稱:AKM 功能描述:16-Bit ツヒ Stereo ADC with PLL & MIC-AMP |
| AK5701KN | 制造商:AKM 制造商全稱:AKM 功能描述:16-Bit ツヒ Stereo ADC with PLL & MIC-AMP |
| AK5701KNP-L | 制造商:AKM Semiconductor Inc 功能描述:AK5701KNP-L |
| AK5701VN | 制造商:AKM 制造商全稱:AKM 功能描述:PLL & MIC-AMP 16-Bit Stereo ADC |
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