參數(shù)資料
型號(hào)： AK5700VN
廠(chǎng)商： Asahi Kasei Microsystems Co.,Ltd
英文描述： 16-Bit ツヒ Mono ADC with PLL & MIC-AMP
中文描述： 16位ツヒ單聲道ADC，帶鎖相環(huán)
文件頁(yè)數(shù)： 24/61頁(yè)
文件大?。?/td> 519K
代理商： AK5700VN
ASAHI KASEI
[AK5700]
MS0569-E-01
2006/12
- 24 -
PLL Master Mode (PMPLL bit = “1”, M/S bit = “1”)
When an external clock (11.2896MHz, 12MHz, 12.288MHz, 13MHz, 13.5MHz, 19.2MHz, 24MHz, 26MHz or 27MHz)
is input to MCKI pin, the MCKO, BCLK and LRCK clocks are generated by an internal PLL circuit. The MCKO output
frequency is selected by PS1-0 bits (see Table 9) and the output is enabled by MCKO bit. The BCLK output frequency is
selected among 32fs or 64fs, by BCKO1-0 bits (see Table 10).
11.2896MHz, 12MHz, 12.288MHz, 13MHz
13.5MHz, 19.2MHz, 24MHz, 26MHz, 27MHz
AK5700
DSP or
μ
P
MCKO
BCLK
LRCK
SDTO
BCLK
LRCK
SDTI
MCKI
1fs
32fs, 64fs
256fs/128fs/64fs/32fs
MCLK
Figure 19. PLL Master Mode
Mode
0
1
2
3
Table 9. MCKO Output Frequency (PLL Mode, MCKO bit = “1”)
PS1 bit
0
0
1
1
PS0 bit
0
1
0
1
MCKO pin
256fs
128fs
64fs
32fs
Default
BCKO1 bit
BCKO0 bit
BCLK Output
Frequency
N/A
32fs
64fs
N/A
0
0
1
1
Table 10. BCLK Output Frequency at Master Mode
0
1
0
1
Default
相關(guān)PDF資料
PDF描述
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