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參數(shù)資料
| 型號(hào)： | 935266871557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA292 |
| 封裝： | PLASTIC, SOT-553-1, BGA-292 |
| 文件頁數(shù)： | 195/532頁 |
| 文件大?。?/td> | 1895K |
| 代理商： | 935266871557 |
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TM1300 Data Book
Philips Semiconductors
22-2
PRODUCT SPECIFICATION
The XIO Bus does not generate parity during XIO Bus
write transfers or check parity during XIO Bus read trans-
fers. This allows the XIO Bus to interface to standard 8-
bit devices without having to add parity-generation and
check logic. While the XIO Bus is active, the XIO Bus log-
ic inhibits parity checking and drives the PCI Parity and
Parity Error pins so that they do not float.
Word transfer is used to transfer the bytes to and from
the PCI bus for hardware simplicity. The primary intend-
ed use of the PCI-XIO Bus is for slow devices, ROMs,
flash EPROMs and I/O. Because the PCI-XIO bus is so
much slower than the TM1300, there is time available for
the TM1300 to pack and unpack the words. In the case
of ROMs and flash EPROMs, the data is typically com-
pressed, requiring the TM1300 CPU to both unpack and
decompress the data.
The PCI-XIO Bus Controller logic reconfigures the byte
enables as control signals for the attached XIO Bus chips
during XIO Bus transfers. It also drives the PCI_TRDY#
signal to the PCI Bus for each transfer. The PCI Bus byte
enables are reconfigured to generate XIO Bus timing sig-
nals: Read (IORD), Write (IOWR) and Data Strobe (DS).
These signals allow ROM, flash EPROM, 68K and x86
devices to be gluelessly interfaced to the XIO Bus. For a
single device, the PCI_INTB# line is used as the global
chip enable. If more than one device is to be added, an
external decoder, such as a 74FCT138, can be used to
decode the upper bits of the 24-bit transfer address, with
Audio In
Audio Out
DSPCPU
400 MIPS
2.5 GOPS
I$
D$
I2C Interface
Image
Co Processor
TM1300
MMI
PCI and External I/O (PCI-XIO) Bus Interface
VLD Assist
Video Out
Digital
DMSD
or Raw
Video
Serial
Digital
Audio
JTAG
XIO Bus
PCI - XIO Bus AD[31:0]
SDRAM: 32-bit data
SDRAM
Highway
Synchronous
Video In
Glueless
Flash
EPROM I/F
XIO
I/O Device
PCI
I/O Device
Clock
Camera
I2C Bus
CCIR 601
Digital
Video Out
V.34 Modem
Controls
PCI Bus
Controls
Serial I/F
Figure 22-1. Partial TM1300 chip block diagram
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 935266917557 | SPECIALTY CONSUMER CIRCUIT, PBGA292 |
| 935268386557 | SPECIALTY CONSUMER CIRCUIT, PBGA292 |
| 935267050025 | SPECIALTY CONSUMER CIRCUIT, UUC |
| 935267053005 | SPECIALTY CONSUMER CIRCUIT, UUC |
| 935267052005 | SPECIALTY CONSUMER CIRCUIT, UUC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935267356112 | 制造商:NXP Semiconductors 功能描述:IC TEA1507PN |
| 935268081112 | 制造商:NXP Semiconductors 功能描述:SUB ONLY IC |
| 935268721125 | 制造商:NXP Semiconductors 功能描述:Buffer/Line Driver 1-CH Non-Inverting 3-ST CMOS 5-Pin TSSOP T/R |
| 935269304128 | 制造商:ST-Ericsson 功能描述:IC AUDIO CODEC W/TCH SCRN 48LQFP |
| 935269544557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY TDA9587-2US1-V1.3 |
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