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參數(shù)資料
| 型號： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡接口) |
| 中文描述： | DS3自動柜員機用戶網(wǎng)絡接口（DS3異步傳輸模式用戶網(wǎng)絡接口） |
| 文件頁數(shù)： | 302/324頁 |
| 文件大小： | 4103K |
| 代理商： | XRT7245 |
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XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
II
Reading Performance Monitor (PMON) Registers ......................................................................................41
For Example .....................................................................................................................................................41
The PMON Holding Register ...........................................................................................................................41
In Summary: Whenever an “8-bit” μC/μP needs to read a PMON Register, it must execute the following steps.
41
On-Chip Register Organization ....................................................................................... 54
Address = 00h, UNI Operating Mode Register ............................................................................................59
Bit 7—Line Loop Back Mode ........................................................................................................................60
Bit 6—Cell Loop Back Mode .........................................................................................................................60
Bit 5—PLCP Loop Back Mode ......................................................................................................................60
Bit 4—Reset ....................................................................................................................................................60
Bit 3—Direct Mapped ATM/PLCP Mode* Selection .....................................................................................60
Bit 2—M13/C-Bit* (DS3 Frame Format) Selection .......................................................................................60
Bits 1, 0—TimRefSel[1, 0] (Timing Reference Select—Transmit PLCP Processor and Transmit DS3 Fram-
er) ....................................................................................................................................................................60
Address = 01h, UNI I/O Control Register .....................................................................................................61
Bit 7—LOC (Loss of Clock)Enable ...............................................................................................................61
Bit 6—Test PMON ..........................................................................................................................................61
Bit 5—Int En Reset (Automatic Reset of Interrupt Enable Bits) Select .....................................................61
Bit 4—AMI/B3ZS* (Line Code) .......................................................................................................................62
Bit 3—Unipolar/Bipolar* (Line Code) ............................................................................................................62
Bit 2—TxLineClk Inv ......................................................................................................................................62
Bit 1—RxLineClk Inv ......................................................................................................................................62
Bit 0—Reframe (Receive DS3 Framer) .........................................................................................................62
Address = 02h, Part Number Register .........................................................................................................62
Address = 03h, Version Number Register ...................................................................................................63
Address = 04h, UNI Interrupt Enable Register ............................................................................................63
Bit 7—Rx DS3 Interrupt Enable ....................................................................................................................63
Bit 6—Rx PLCP Interrupt Enable ..................................................................................................................63
Bit 5—Rx CP Interrupt Enable ......................................................................................................................63
Bit 4—Rx UTOPIA Interrupt Enable ..............................................................................................................63
Bit 3—Tx UTOPIA Interrupt Enable ..............................................................................................................64
Bit 2—Tx CP Interrupt Enable .......................................................................................................................64
Bit 1—Tx DS3 Framer Interrupt Enable ........................................................................................................64
Bit 0—One Second Interrupt Enable ............................................................................................................64
Address = 05h, UNI Interrupt Status Register .............................................................................................64
Bit 7—Rx DS3 (Framer) Interrupt Status ......................................................................................................64
Bit 6—Rx PLCP Interrupt Status ...................................................................................................................65
Bit 5—Rx CP (Cell Processor) Interrupt Status ...........................................................................................65
Bit 4—Rx UTOPIA Interrupt Status ...............................................................................................................65
Bit 3—Tx UTOPIA Interrupt Status ...............................................................................................................65
Bit 2—Tx CP (Cell Processor) Interrupt Status ...........................................................................................65
Bit 1—Tx DS3 (Framer) Interrupt Status ......................................................................................................65
Bit 0—One Second Interrupt Status .............................................................................................................66
相關PDF資料 |
PDF描述 |
|---|---|
| XRT7288IP | CEPT1 Line Interface |
| XRT7288 | CEPT1 Line Interface(CEPT1線接口) |
| XRT7288IW | CEPT1 Line Interface |
| XRT7295AE | E3 (34.368Mbps) Integrated line Receiver |
| XRT7295AE_03 | E3 (34.368Mbps) Integrated line Receiver |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT7250 | 制造商:EXAR 制造商全稱:EXAR 功能描述:DS3/E3 FRAMER IC |
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| XRT7250IQ100 | 制造商:EXAR 制造商全稱:EXAR 功能描述:DS3/E3 FRAMER IC |
| XRT7288 | 制造商:EXAR 制造商全稱:EXAR 功能描述:CEPT1 Line Interface |
| XR-T7288 | 制造商:EXAR 制造商全稱:EXAR 功能描述:CEPT1 Line Interface |
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