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參數(shù)資料
| 型號(hào)： | PD780336GC-XXX-9EV |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁(yè)數(shù)： | 40/421頁(yè) |
| 文件大?。?/td> | 2323K |
| 代理商： | PD780336GC-XXX-9EV |
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40
CHAPTER 1 OUTLINE
User
’
s Manual U14701EJ3V0UD
1.6.2
μ
PD780326, 780328
Remark
The internal ROM capacity varies depending on the product.
16-bit timer/
event counter 0
16-bit timer/
event counter 4
8-bit timer/
event counter 50
8-bit timer/
event counter 51
8-bit timer/
event counter 52
Watch timer
Watchdog timer
Port 0
P00 to P05
TO0/P30
TI00/P31
TI01/P32
TO4/P70
TI4/P71
TI50/TO50/P33
TI51/TO51/P34
TO52/P72
TI52/P73
SI1/P23
SO1/P24
SCK1/P25
SI3/R
X
D0/P20
SO3/T
D0/P21
SCK3/P22
R
X
D0/P20
T
X
D0/P21
INTP0/P00 to INTP2/P02,
INTP3/ADTRG/P03,
INTP4/P04,
INTP5/BUZ/PCL/P05
PCL/BUZ/INTP5/P05
ANI0/P10 to ANI7/P17,
ANI8, ANI9
AV
SS0
AV
REF0
AO0/P120
AV
SS0
AV
REF1
V
DD0
, V
DD1
ADTRG/INTP3/P03
6
Port 1
P10 to P17
8
Port 2
P20 to P25
6
Port 3
P30 to P34
5
Port 4
P40 to P47
8
Port 5
78K/0
CPU
core
ROM
P50 to P57
8
Port 6
P60 to P67
8
Port 7
P70 to P73
4
Port 8
P80 to P87
8
Port 12
P120
COM0 to COM3
SCOM0
S0 to S31
V
LC0
to V
LC2
V
LCDC
CAPH, CAPL
RESET
X1
X2
XT1
XT2
1
Serial
interface CSI1
Serial
interface SIO3
UART0
Interrupt
control
Clock/buzzer
output control
A/D converter 0
D/A converter 0
Internal
high-speed
RAM
1,024 bytes
Internal
expansion
RAM
1,536 bytes
LCD controller/
converter
System
control
V
SS0
, V
SS1
IC
4
32
6
10
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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