參數(shù)資料
型號(hào)： MPC565MZP56R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁(yè)數(shù)： 702/1387頁(yè)
文件大?。?/td> 18462K
代理商： MPC565MZP56R2
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MOTOROLA
Chapter 9. External Bus Interface
9-7
Bus Interface Signal Descriptions
BI
Burst inhibit
1
Low
I
Driven by the slave device to which the current
transaction was addressed. Indicates that the current
slave does not support burst mode.
O
Driven by the MPC565/MPC566 when the slave
device is controlled by the on-chip memory controller.
the MPC565/MPC566 also asserts BI for any external
master burst access to internal MPC565/MPC566
memory space.
Arbitration
BR
Bus request
1
Low
I
When the internal arbiter is enabled, BR assertion
indicates that an external master is requesting the bus.
O
Driven by the MPC565/MPC566 when the internal
arbiter is disabled and the chip is not parked.
BG
Bus grant
1
Low
O
When the internal arbiter is enabled, the
MPC565/MPC566 asserts this signal to indicate that
an external master may assume ownership of the bus
and begin a bus transaction. The BG signal should be
qualified by the master requesting the bus in order to
ensure it is the bus owner:
Qualified bus grant = BG &~ BB
I
When the internal arbiter is disabled, BG is sampled
and properly qualified by the MPC565/MPC566 when
an external bus transaction is to be executed by the
chip.
BB
Bus busy
1
Low
O
When the internal arbiter is enabled, the
MPC565/MPC566 asserts this signal to indicate that it
is the current owner of the bus.
When the internal arbiter is disabled, the
MPC565/MPC566 asserts this signal after the external
arbiter has granted the ownership of the bus to the
chip and it is ready to start the transaction.
I
When the internal arbiter is enabled, the
MPC565/MPC566 samples this signal to get indication
of when the external master ended its bus tenure (BB
negated).
When the internal arbiter is disabled, the BB is
sampledtoproperly qualifythe BG line when an
external bus transaction is to be executed by the chip.
RETRY
1
Low
I
In the case of regular transaction, this signal is driven
by the slave device to indicate that the
MPC565/MPC566 must relinquish the ownership of
thebus andretry thecycle.
O
When an external master owns the bus and the
internal MPC565/MPC566 bus initiates access to the
external bus at the same time, this signal is used to
cause the external master to relinquish the bus for one
clock to solve the contention.
Table 9-1. MPC565/MPC566 SIU Signals (continued)
Signal Name
Pins
Active
I/O
Description
相關(guān)PDF資料
PDF描述
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC60333 32-BIT, 33.33 MHz, RISC PROCESSOR, CQFP240
MPC603CQ50 32-BIT, 50 MHz, RISC PROCESSOR, CQFP240
MPC60340 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
MPC603CQ40 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC566 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEXUS Debugger and Trace for PowerPC
MPC5668E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668G 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMG 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMGR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
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