參數(shù)資料
型號(hào)： MPC565MZP56R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁(yè)數(shù)： 38/1387頁(yè)
文件大?。?/td> 18462K
代理商： MPC565MZP56R2
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MOTOROLA
Chapter 23. READI Module
23-9
Programming Model
23.2 Programming Model
This section describes the READI programmer’s model. READI resources can only be
configured and accessed via the auxiliary port.
The READI registers do not follow the recommendations of the IEEE-ISTO 5001-1999,
but are loosely based on the 0.9 release of the standard.
23.2.1 Register Map
READI registers are accessible via the auxiliary port. They can be classified into two
categories: user mapped registers and tool mapped registers.
23.2.1.1 User Mapped Register
The operating system writes the ID for the current task/process in the OTR register.
Table 23-5 shows the location of the register bits. Their functions are explained below.
READI pins
Refers to IEEE-ISTO 5001 auxiliary port.
RPM
Reduced Port Mode. This is the alternate port mode for READI.
run-time
RCPU is executing program code in normal mode
Sequential Instruction
Any instruction other than a flow-control instruction or isync.
Snooping
Monitoring addresses driven by a bus master to detect the need for coherency actions.
Standard
The phrase “according to the standard” implies according the IEEE-ISTO 5001 - 1999.
Superfield
One or more message “fields” delimited by MSEO/MSEI assertion/negation.
The information transmitted between “start-message” and “end-packet” states.
Show Cycle
An internal access (e.g., to an internal memory) reflected on the external bus using a
special cycle (marked with a dedicated transfer code). For an internal memory “hit,” an
address-only bus cycle is generated; for an internal memory “miss,” a complete bus cycle is
generated.
Transfer Code (TCODE) Message header that identifies the number and/or size of packets to be transferred, and how
to interpret each of the packets.
TCK_DSCK
Multiplexed pin: JTAG Clock or Development Port Clock.
TDI_DSDI
Multiplexed pin: JTAG Data In or Development Port Serial Data In.
TDO_DSDO
Multiplexed pin: JTAG Data Out or Development Port Serial Data Out.
Upload
Device sends information to the tool.
VSYNC
Internal RCPU signal
VF
Internal RCPU signal which indicates instruction queue status.
VFLS
Internal RCPU signal which indicates history buffer flush status.
Table 23-4. Terms and Definitions (continued)
Term
Description
相關(guān)PDF資料
PDF描述
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC60333 32-BIT, 33.33 MHz, RISC PROCESSOR, CQFP240
MPC603CQ50 32-BIT, 50 MHz, RISC PROCESSOR, CQFP240
MPC60340 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
MPC603CQ40 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MPC566 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEXUS Debugger and Trace for PowerPC
MPC5668E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668G 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMG 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMGR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
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