參數(shù)資料
型號(hào)： MPC565MZP56R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁(yè)數(shù)： 464/1387頁(yè)
文件大?。?/td> 18462K
代理商： MPC565MZP56R2
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MOTOROLA
Chapter 3. Central Processing Unit
3-15
User Instruction Set Architecture (UISA) Register Set
FEX and VX are the logical ORs of other FPSCR bits. Therefore these two bits are not
listed among the FPSCR bits directly affected by the various instructions.
A listing of FPSCR bit settings is shown in Table 3-5.
MSB
0
1
23456
789
10
11
12
13
14
15
FX
FEX
VX
OX
UX
ZX
XX
VXSN
AN
VXISI VXIDI VXZD
Z
VXIM
Z
VXVC
FR
FI
FPRF
0
RESET: UNCHANGED
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
LSB
31
FPRF[1:4]
0
VXSO
FT
VXSQ
RT
VXCV
I
VE
OE
UE
ZE
XE
NI
RN
RESET: UNCHANGED
Figure 3-6. FPSCR — Floating-Point Status and Control Register
Table 3-5. FPSCR Bit Descriptions
Bit(s)
Name
Description
0
FX
Floating-point exception summary. Every floating-point instruction implicitly
sets FPSCR[FX] if that instruction causes any of the floating-point exception
bits in the FPSCR to change from 0 to 1. The mcrfs instruction implicitly clears
FPSCR[FX] if the FPSCR field containing FPSCR[FX] has been copied. The
mtfsf, mtfsfi, mtfsb0, and mtfsb1 instructions can set or clear FPSCR[FX]
explicitly.
Sticky bit
1
FEX
Floating-point enabled exception summary. This bit signals the occurrence of
any of the enabled exception conditions. It is the logical OR of all the
floating-point exception bits masked with their respective enable bits. The
mcrfs instruction implicitly clears FPSCR[FEX] if the result of the logical OR
described above becomes zero. The mtfsf, mtfsfi, mtfsb0, and mtfsb1
instructions cannot set or clear FPSCR[FEX] explicitly.
Not sticky
2
VX
Floating-point invalid operation exception summary. This bit signals the
occurrence of any invalid operation exception. It is the logical OR of all of the
invalid operation exceptions. The mcrfs instruction implicitly clears
FPSCR[VX] if the result of the logical OR described above becomes zero. The
mtfsf, mtfsfi, mtfsb0, and mtfsb1 instructions cannot set or clear FPSCR[VX]
explicitly.
Not sticky
3
OX
Floating-point overflow exception.
Sticky bit
4
UX
Floating-point underflow exception.
Sticky bit
5
ZX
Floating-point zero divide exception.
Sticky bit
6
XX
Floating-point inexact exception.
Sticky bit
7
VXSNAN
Floating-point invalid operation exception for SNaN.
Sticky bit
8
VXISI
Floating-point invalid operation exception for
∞ - ∞.Sticky bit
9
VXIDI
Floating-point invalid operation exception for
∞/∞.Sticky bit
10
VXZDZ
Floating-point invalid operation exception for 0/0.
Sticky bit
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PDF描述
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