參數資料
型號： MPC565MZP56R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, MO-151AAL-1, BGA-388
文件頁數： 660/1387頁
文件大?。?/td> 18462K
代理商： MPC565MZP56R2
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MOTOROLA
Chapter 8. Clocks and Power Control
8-7
Low-Power Divider
NOTE
When the VCO is the system clock source, chip operation is
unpredictable while the PLL is unlocked. Note further that a
switch to the backup clock is possible only if the LME bit in the
SCCR is set.
8.4
Low-Power Divider
The output of the PLL is sent to a low-power divider block. (In limp mode the BUCLK is
sent to a low-power divider block.) This block generates all other clocks in normal
operation, but has the ability to divide the output frequency of the VCO before it generates
the general system clocks sent to the rest of the MPC565/MPC566. The PLL VCOOUT is
always divided by at least two.
The purpose of the low-power divider block is to allow reduction and restoration of the
operating frequencies of different sections of the MPC565/MPC566 without losing the PLL
lock. Using the low-power divider block, full chip operation can still be obtained, but at a
lower frequency. This is called gear mode. The selection and speed of gear mode can be
changed at any time, with changes occurring immediately.
The low-power divider block is controlled in the system clock control register (SCCR). The
default state of the low-power divider is to divide all clocks by one. Thus, for a 40-MHz
system, the general system clocks are each 40 MHz. Whenever power-on reset is asserted,
the MF bits are set according to Table 8-1, and the division factor high frequency (DFNH)
and division factor low frequency (DFNL) bits in SCCR are set to the value of 0 (
÷1for
DFNH and
÷2 for DFNL).
8.5
Internal Clock Signals
The internal clocks generated by the clocks module are shown in Figure 8-4. The clocks
module also generates the CLKOUT and ENGCLK external clock signals. The PLL
synchronizes these signals to each other. The PITRTCLK frequency and source are
specified by the RTDIV and RTSEL bits in the SCCR. When the backup clock is
functioning as the system clock, the backup clock is automatically selected as the time base
clock source and is twice the MPC565/MPC566 system clock.
相關PDF資料
PDF描述
MPC565CVR56 32-BIT, FLASH, 56 MHz, RISC MICROCONTROLLER, PBGA388
MPC60333 32-BIT, 33.33 MHz, RISC PROCESSOR, CQFP240
MPC603CQ50 32-BIT, 50 MHz, RISC PROCESSOR, CQFP240
MPC60340 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
MPC603CQ40 32-BIT, 40 MHz, RISC PROCESSOR, CQFP240
相關代理商/技術參數
參數描述
MPC566 制造商:未知廠家 制造商全稱:未知廠家 功能描述:NEXUS Debugger and Trace for PowerPC
MPC5668E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668G 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMG 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
MPC5668GF0AVMGR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC5668x Microcontroller Data Sheet
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