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參數(shù)資料
| 型號(hào)： | MC68306PV16 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 16.67 MHz, MICROPROCESSOR, PQFP144 |
| 封裝： | PLASTIC, TQFP-144 |
| 文件頁數(shù)： | 21/191頁 |
| 文件大?。?/td> | 1311K |
| 代理商： | MC68306PV16 |
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MOTOROLA
MC68306 USER'S MANUAL
6-9
6.3.2.1 TRANSMITTER. The transmitters are enabled through their respective command
registers (DUCR) located within the serial module. The serial module signals the CPU
when it is ready to accept a character by setting the transmitter-ready bit (TxRDY) in the
channel's status register (DUSR). Functional timing information for the transmitter is
shown in Figure 6-5.
The transmitter converts parallel data from the CPU to a serial bit stream on TxDx. It
automatically sends a start bit followed by the programmed number of data bits, an
optional parity bit, and the programmed number of stop bits. The least significant bit is
sent first. Data is shifted from the transmitter output on the falling edge of the clock
source.
C1
C2
C3
C4
C6
W
C1
C2
C3
C4
STOP
BREAK
START
BREAK
C5
NOT
TRANSMITTED
C6
BREAK
C1 IN
TRANSMISSION
TxDx
TRANSMITTER
ENABLED
TxRDY
(SR2)
CS
CTS
(IP0)
RTS
(OP0)
2
1
NOTES:
1. TIMING SHOWN FOR MR2(4) = 1
2. TIMING SHOWN FOR MR2(5) = 1
3. C = TRANSMIT CHARACTER
4. W = WRITE
N
MANUALLY ASSERTED
BY BIT- SET COMMAND
MANUALLY
ASSERTED
Figure 6-5. Transmitter Timing Diagram
Following transmission of the stop bits, if a new character is not available in the transmitter
holding register, the TxDx output remains high ('mark' condition), and the transmitter
empty bit (TxEMP) in the DUSR is set. Transmission resumes and the TxEMP bit is
cleared when the CPU loads a new character into the transmitter buffer (DUTB). If a
disable command is sent to the transmitter, it continues operating until the character in the
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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