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參數(shù)資料
| 型號： | MC68306PV16 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 16.67 MHz, MICROPROCESSOR, PQFP144 |
| 封裝： | PLASTIC, TQFP-144 |
| 文件頁數(shù)： | 113/191頁 |
| 文件大?。?/td> | 1311K |
| 代理商： | MC68306PV16 |
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2- 8
MC68306 USER'S MANUAL
MOTOROLA
additional information about the interaction between HALT and RESET , refer to 3.5 Reset
Operation and for more information on HALT and BERR , refer to 3.4 Bus Error and Halt
Operation.
Processor assertion of HALT indicates a double bus fault condition. This condition is
unrecoverable; the MC68306 must be externally reset to resume operation.
2.1.12 Read/Write (R/
W)
This three-state, bi-directional signal defines the data bus transfer as a read or write cycle.
The R/W signal relates to the data strobe signals described in the following paragraphs.
2.1.13 Upper And Lower Data Strobes (
UDS, LDS)
These three-state, bi-directional signals and R/W control the flow of data on the data bus.
Table 2-9 lists the combinations of these signals, the corresponding data on the bus, and
the OE, LW, and UW signals. When the R/W line is high, the processor reads from the
data bus. When the R/W line is low, the processor drives the data bus. When another bus
master controls the bus, the UDS, LDS, and R/ W pins become inputs and the OE, LW,
and UW signals are still decoded as shown in Table 2-9.
Table 2-9. Data Strobe Control of Data Bus
UDS
LDS
R/
W
D8–D15
D0–D7
OE
UW
LW
High
—
No Valid Data
High
Low
High
Valid Data Bits
15–8
Valid Data Bits
7–0
Low
High
Low
High
No Valid Data
Valid Data Bits
7–0
Low
High
Low
High
Valid Data Bits
15–8
No Valid Data
Low
High
Low
Valid Data Bits
15–8
Valid Data Bits
7–0
High
Low
High
Low
Valid Data Bits
7–0*
Valid Data Bits
7–0
High
Low
High
Low
Valid Data Bits
15–8
Valid Data Bits
15–8*
High
Low
High
*These conditions are a result of current implementation and may not appear
on future devices.
2.1.14 Upper-Byte Write (
UW)
This signal is a combination of R/W low and UDS low for writing the upper-byte of a 16-bit
port. This signal simplifies memory system design by explicitly signalling that data is valid
on the upper portion of the data bus on a write operation. UW is also decoded for external
bus masters.
F
re
e
sc
a
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S
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c
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68450LC-8 | 4 CHANNEL(S), 8 MHz, DMA CONTROLLER, CDIP64 |
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| MC68681P | 2 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PDIP40 |
| MC68838FCC | 1 CHANNEL(S), 125M bps, FDDI CONTROLLER, CQFP120 |
| MC68EC020FG | 32-BIT, 25 MHz, MICROCONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68306PV20B | 制造商:Rochester Electronics LLC 功能描述:INTEGRATED EC000 MPU - Bulk |
| MC68307 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Technical Summary Integrated Multiple-Bus Processor |
| MC68307AD | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Technical Summary Integrated Multiple-Bus Processor |
| MC68307UM | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Technical Summary Integrated Multiple-Bus Processor |
| MC68307V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Technical Summary Integrated Multiple-Bus Processor |
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