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參數(shù)資料
| 型號： | HDMP-1032 |
| 英文描述： | 1.4 GBd Transmitter Chip Set with CIMT Encoder/Decoder and Variable Data Rate(帶CIMT編碼器/譯碼器和變量數(shù)據(jù)速率的1.4 GBd 傳送器) |
| 中文描述： | 1.4 GBd發(fā)射機芯片組與CIMT編碼器/解碼器和可變數(shù)據(jù)速率（帶CIMT編碼器/譯碼器和變量數(shù)據(jù)速率的1.4 GBd傳送器） |
| 文件頁數(shù)： | 28/32頁 |
| 文件大?。?/td> | 346K |
| 代理商： | HDMP-1032 |
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28
Figure 15. Methods of Interfacing HS_OUT and HS_IN.
Tx
HDMP-1032
Rx
HDMP-1034
50
50
A) G-LINK Tx TO Rx INTERCONNECTION
HSOUT+
HSOUT–
HSIN+
HSIN–
0.1
μ
F
0.1
μ
F
NOTE THAT NO EXTERNAL TERMINATIONS OR BIAS RESISTORS ARE REQUIRED.
R2
R1
+V
CC
0.1
μ
F
PECL INPUT
Tx
HDMP-1032
Z0
Z0
B) DIFFERENTIAL DRIVE TO GENERIC PECL INPUT
HSOUT+
HSOUT–
0.1
μ
F
0.1
μ
F
THE THEVENIN EQUIVALENT RESISTANCE IS EQUAL TO THE TRANSMISSION LINE
IMPEDANCE (Z0) AND PROVIDES PROPER DC BIAS TO THE PECL INPUTS.
R2
R1
+
_
191
68
+5 V
0.1
μ
F
OPTICAL
TRANSCEIVER
(+5 V)
Tx
HDMP-1032
50
50
D) G-LINK INTERFACE TO OPTICAL TRANSCEIVER
HSOUT+
HSOUT–
0.1
μ
F
0.1
μ
F
191
68
270
Rx
HDMP-1034
50
50
HSIN+
HSIN–
0.1
μ
F
0.1
μ
F
270
RD+
RD–
TD+
TD–
PECL OUTPUT
Rx
HDMP-1034
Z0
Z0
C) GENERIC PECL OUTPUT TO G-LINK Rx INPUT
HSIN+
HSIN–
0.1
μ
F
0.1
μ
F
RESISTOR VALUE R1 SETS PROPER BIAS FOR THE PECL OUTPUT STAGE.
THE G-LINK Rx IS INTERNALLY TERMINATED AND DOESN'T REQUIRE
EXTERNAL BIAS OR TERMINATION RESISTORS.
R1
R1
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