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參數(shù)資料
| 型號(hào)： | DS3106LN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 60/92頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TIMING LINE CARD 64-LQFP |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 類型： | 定時(shí)卡 IC，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum，電信 |
| 輸入： | CMOS，TTL |
| 輸出： | CMOS，LVDS，LVPECL，TTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 312.5MHz |
| 電源電壓： | 1.62 V ~ 1.98 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應(yīng)商設(shè)備封裝： | 64-LQFP（10x10） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 1429 (CN2011-ZH PDF) |
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DS3106
63
Register Name:
OCR4
Register Description:
Output Configuration Register 4
Register Address:
63h
Bit #
7
6
5
4
3
2
1
0
Name
MFSEN
FSEN
0
Default
1
0
Bit 7: MFSYNC Enable (MFSEN). This configuration bit enables the 2kHz output on the MFSYNC pin. See Section
0 = Disabled, driven low
1 = Enabled, output is 2kHz
Bit 6: FSYNC Enable (FSEN). This configuration bit enables the 8kHz output on the FSYNC pin. See Section
0 = Disabled, driven low
1 = Enabled, output is 8kHz
Register Name:
T4CR1
Register Description:
T4 DPLL Configuration Register 1
Register Address:
64h
Bit #
7
6
5
4
3
2
1
0
Name
—
T4FREQ[3:0]
Default
0
see below
Bits 3 to 0: T4 APLL Frequency (T4FREQ[3:0]). When T0CR1:T4APT0 = 0, this field configures the T4 APLL
DFS frequency. The T4 APLL DFS frequency affects the frequency of the T4 APLL which, in turn, affects the
available output frequencies on the output clock pins (see the OCR registers). See Section 7.8.2. The default value
of this field is controlled by the O6F[2:0] and O3F[2:0] pins as described in Table 7-15.
T4FREQ[3:0]
T4 APLL DFS FREQUENCY
T4 APLL FREQUENCY (4 x T4 APLL DFS)
0000
APLL output disabled
Disabled, output is low
0001
77.76MHz
311.04MHz (4 x 77.76MHz)
0010
24.576MHz (12 x E1)
98.304MHz (48 x E1)
0011
32.768MHz (16 x E1)
131.072MHz (64 x E1)
0100
37.056MHz (24 x DS1)
148.224MHz (96 x DS1)
0101
24.704MHz (16 x DS1)
98.816MHz (64 x DS1)
0110
68.736MHz (2 x E3)
274.944MHz (8 x E3)
0111
44.736MHz (DS3)
178.944MHz (4 x DS3)
1000
25.248MHz (4 x 6312kHz)
100.992MHz (16 x 6312kHz)
1001
62.500MHz (GbE
÷ 16)
250.000MHz (GbE
÷ 4)
1010
30.720MHz (3 x 10.24)
122.880MHz (12 x 10.24)
1011
40.000MHz (4 x 10MHz)
160.000MHz (16 x 10MHz)
1100
26.000MHz (2 x 13MHz)
104.000MHz (8 x 13MHz)
1101–1111
{unused values}
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PDF描述 |
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參數(shù)描述 |
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| DS3107MP00K | 制造商:Thomas & Betts 功能描述:30A,PLG,2P3W,MG,107,125V,CC |
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