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參數(shù)資料
| 型號： | CL-PS7111-VC-A |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Low-Power System-on-a-Chip |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP208 |
| 封裝： | VQFP-208 |
| 文件頁數(shù)： | 47/105頁 |
| 文件大?。?/td> | 1207K |
| 代理商： | CL-PS7111-VC-A |
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PRELIMINARY DATA BOOK v2.0
September 1997
46
REGISTER DESCRIPTIONS
CL-PS7111
Low-Power System-on-a-Chip
All internal registers in the CL-PS7111 are reset (cleared to ‘0’) by a system reset (NPOR, NRESET, or
NPWRFL), except for DRFPR, RTCDR, and RTCMR that are only reset when NPOR becomes active.
This ensures that DRAM contents and system time are preserved through a user-reset or power-fail con-
dition.
8000.0880–
8000.0FFF
Reserved
–
–
–
Write has no effect; read is undefined
–
8000.1000
FRBADDR
C
RW
4
LCD Frame Buffer Start Address register
70
8000.1100
SYSCON2
0
RW
16
System Control register 2
70
8000.1140
SYSFLG2
0
R
16
System Status Flag register 2
71
8000.1240
INTSR2
0
R
24
Interrupt Status register 2
72
8000.1280
INTMR2
0
RW
16
Interrupt Mask register 2
72
8000.1480
UARTDR2
0
RW
8
UART2 Data register
64
8000.14C0
UBRLCR2
0
RW
32
UART2 Control register
65
8000.1700
KBDEOI
–
–
–
Write to clear keyboard interrupt
72
8000.1840–
BFFF.FFFF
Reserved
–
–
–
This area contains test registers used during manufactur-
ing tests. Never attempt to write to these addresses dur-
ing normal operation as this can cause unexpected
behavior. Reads are undefined.
–
Table 5-2.
Port Byte Addresses in Big-Endian Mode
Address
Name
Default
R/W
Size
Comments
8000.0003
PADR
0
RW
8
Port A Data register
8000.0002
PBDR
0
RW
8
Port B Data register
8000.0001
–
–
8
Reserved
8000.0000
PDDR
0
RW
8
Port D Data register
8000.0043
PADDR
0
RW
8
Port A Data Direction register
8000.0042
PBDDR
0
RW
8
Port B Data Direction register
8000.0041
–
–
8
Reserved
8000.0040
PDDDR
0
RW
8
Port D Data Direction register
8000.0200
DRFPR
0
RW
8
DRAM Refresh Period register
8000.0440
CODR
0
RW
8
Codec Data I/O register
8000.0480
UARTDR1
0
RW
8
UART1 FIFO Data register
8000.1480
UARTDR2
0
RW
8
UART2 FIFO Data register
Table 5-1.
Internal I/O Memory Locations in Little-Endian Mode
(cont.)
Address
Name
Default
R/W
Size
Comments
Page
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CL-PS7500FE | System-on-a Chip for Internet Appliance |
| CL-SH8665 | Integrated ATA Drive microcontroller(集成ATA驅(qū)動微控制器) |
| CL1431 | Precision Adjustable Shunt Reference |
| CL1431D | Precision Adjustable Shunt Reference |
| CL1431LP | Precision Adjustable Shunt Reference |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CL-PS7500FE | 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:System-on-a Chip for Internet Appliance |
| CLPT-12SP-06 | 制造商:Tri-Star Electronics International 功能描述:CONNECTOR - Bulk |
| CLPT-12SP-67 | 制造商:Tri-Star Electronics International 功能描述:- Bulk |
| CL-PU/O | 制造商:Maxell 功能描述:Couleur® Stereo Ear Buds w/ Multi-Size Ear Tips - Purple/Orange |
| CL-PX0070-30QC-A | 制造商:Cirrus Logic 功能描述:TRAY OF 19 3 OF THEM SLIGHTLY BENT LEADS |
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