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參數(shù)資料
| 型號： | BX80551PG3000FN |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 3000 MHz, MICROPROCESSOR, PBGA775 |
| 封裝： | FLIP CHIP, LGA-775 |
| 文件頁數(shù)： | 61/106頁 |
| 文件大?。?/td> | 2713K |
| 代理商： | BX80551PG3000FN |
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Land Listing and Signal Descriptions
58
Datasheet
F19
VSS
Power/Other
F20
D41#
Source Synch
Input/Output
F21
D43#
Source Synch
Input/Output
F22
VSS
Power/Other
F23
RESERVED
F24
TESTHI7
Power/Other
Input
F25
TESTHI2
Power/Other
Input
F26
TESTHI0
Power/Other
Input
F27
VTT_SEL
Power/Other
Output
F28
BCLK0
Clock
Input
F29
RESERVED
G1
VSS
Power/Other
G2
COMP2
Power/Other
Input
G3
TESTHI8
Power/Other
Input
G4
TESTHI9
Power/Other
Input
G5
FC7
Source Synch
Output
G6
RESERVED
G7
DEFER#
Common Clock
Input
G8
BPRI#
Common Clock
Input
G9
D16#
Source Synch
Input/Output
G10
RESERVED
G11
DBI1#
Source Synch
Input/Output
G12
DSTBN1#
Source Synch
Input/Output
G13
D27#
Source Synch
Input/Output
G14
D29#
Source Synch
Input/Output
G15
D31#
Source Synch
Input/Output
G16
D32#
Source Synch
Input/Output
G17
D36#
Source Synch
Input/Output
G18
D35#
Source Synch
Input/Output
G19
DSTBP2#
Source Synch
Input/Output
G20
DSTBN2#
Source Synch
Input/Output
G21
D44#
Source Synch
Input/Output
G22
D47#
Source Synch
Input/Output
G23
RESET#
Common Clock
Input
G24
TESTHI6
Power/Other
Input
G25
TESTHI3
Power/Other
Input
G26
TESTHI5
Power/Other
Input
G27
TESTHI4
Power/Other
Input
G28
BCLK1
Clock
Input
G29
BSEL0
Power/Other
Output
G30
BSEL2
Power/Other
Output
Table 4-2. Numerical Land Assignment
Land
#
Land Name
Signal Buffer
Type
Direction
H1
GTLREF0
Power/Other
Input
H2
GTLREF1
Power/Other
Input
H3
VSS
Power/Other
H4
RSP#
Common Clock
Input
H5
TESTHI10
Power/Other
Input
H6
VSS
Power/Other
H7
VSS
Power/Other
H8
VSS
Power/Other
H9
VSS
Power/Other
H10
VSS
Power/Other
H11
VSS
Power/Other
H12
VSS
Power/Other
H13
VSS
Power/Other
H14
VSS
Power/Other
H15
DP1#
Common Clock
Input/Output
H16
DP2#
Common Clock
Input/Output
H17
VSS
Power/Other
H18
VSS
Power/Other
H19
VSS
Power/Other
H20
VSS
Power/Other
H21
VSS
Power/Other
H22
VSS
Power/Other
H23
VSS
Power/Other
H24
VSS
Power/Other
H25
VSS
Power/Other
H26
VSS
Power/Other
H27
VSS
Power/Other
H28
VSS
Power/Other
H29
GTLREF_SEL
Power/Other
Output
H30
BSEL1
Power/Other
Output
J1
VTT_OUT_LEFT
Power/Other
Output
J2
FC3
Power/Other
Input
J3
FC22
Power/Other
Input
J4
VSS
Power/Other
J5
REQ1#
Source Synch
Input/Output
J6
REQ4#
Source Synch
Input/Output
J7
VSS
Power/Other
J8
VCC
Power/Other
J9
VCC
Power/Other
J10
VCC
Power/Other
J11
VCC
Power/Other
Table 4-2. Numerical Land Assignment
Land
#
Land Name
Signal Buffer
Type
Direction
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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