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參數(shù)資料
| 型號(hào)： | 935266917557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類(lèi)： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA292 |
| 封裝： | PLASTIC, SOT-553-1, BGA-292 |
| 文件頁(yè)數(shù)： | 129/532頁(yè) |
| 文件大?。?/td> | 1895K |
| 代理商： | 935266917557 |
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TM1300 Data Book
Philips Semiconductors
14-16
PRODUCT SPECIFICATION
up scaled by 2 relative to the Y component for YUV 4:4:4
output, although they could be up scaled as part of gen-
eral up scaling of the image.
The YUV 4:2:2 output mode also provides higher pro-
cessing bandwidth relative to YUV 4:4:4 up scaling. Half
as many U and V pixels are processed.The output pixel
rate is one pixel per 20 nanoseconds for the YUV 4:2:2
output mode versus one pixel per 30 for conversion to
YUV 4:4:4. This can be used to provide some processing
performance improvement for very large images at the
expense of some chroma quality.
14.5.9.2
PCI output block timing
The ICP outputs pixels to the PCI interface at a peak rate
of 33 Mpix/sec in RGB mode and 50 Mpix/second in the
YUV mode using YUV sequencing. For one word per pix-
el output codes, such as RGB-24, this is a peak rate of
33 Mwords/sec or 132 Mpix/sec in the RGB sequencing
mode. This is the same speed as the 132 MB/sec peak
rate of the PCI interface. (At 50 Mpix/sec, the result
would be 200 MB/sec.) The BIU control for the PCI inter-
face has a FIFO for buffering data from the ICP, but this
buffer is only 16 words deep. Therefore, the ICP will oc-
casionally have to wait for the PCI to accept more data.
In the PCI output mode, this stalls the ICP clock.
14.6
OPERATION AND PROGRAMMING
The ICP uses a combination of hardware and a Micro-
program Control Unit (MCU) to implement its scaling, fil-
tering and conversion functions. The microprogram is a
T
o
PCI
5 Stage Multiplier-
Accumulator
Y, U, V LSBs
Reg
a
+2
RAM
a
+1
RAM
a
+0
RAM
a
-1
RAM
a
-2
RAM
Y Counter
Y LSB Counter
Buffers 0,1
Block FIFO
Filter Source Select
5-tap Filter
Reg
U Counter
U LSB Counter
Buffers 2,3
Block FIFO
Reg
V Counter
V LSB Counter
Buffers 4,5
Block FIFO
Reg
OL Counter
B, BX Counter
Buffer 8
Bit Mask
Buffers 6,7
Overlay
FIFO
Multiple
x
er:
Y
,U
,V
Select
Mux
YUV
to
RGB
Con
ver
sion,
Formatting,
Alpha
Blending
&
Bit
Masking
YUV
Counter
Sequence
Pixel
Clock
Y, U, V Data FIFO Clocks
Mirr
or
Multiple
x
e
r
Y Mirror Cntr
U Mirror Cntr
V Mirror Cntr
Mux
RGB to SDRAM case
RGB to PCI case
Figure 14-16. ICP horizontal scaling for RGB output data flow block diagram
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 935268386557 | SPECIALTY CONSUMER CIRCUIT, PBGA292 |
| 935267050025 | SPECIALTY CONSUMER CIRCUIT, UUC |
| 935267053005 | SPECIALTY CONSUMER CIRCUIT, UUC |
| 935267052005 | SPECIALTY CONSUMER CIRCUIT, UUC |
| 935267395518 | COLOR SIGNAL DECODER, PBGA156 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935267356112 | 制造商:NXP Semiconductors 功能描述:IC TEA1507PN |
| 935268081112 | 制造商:NXP Semiconductors 功能描述:SUB ONLY IC |
| 935268721125 | 制造商:NXP Semiconductors 功能描述:Buffer/Line Driver 1-CH Non-Inverting 3-ST CMOS 5-Pin TSSOP T/R |
| 935269304128 | 制造商:ST-Ericsson 功能描述:IC AUDIO CODEC W/TCH SCRN 48LQFP |
| 935269544557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY TDA9587-2US1-V1.3 |
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