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參數(shù)資料
| 型號： | XRT82L24IV |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | QUAD E1 LINE TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR |
| 中文描述： | DATACOM, PCM TRANSCEIVER, PQFP100 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, TQFP-100 |
| 文件頁數(shù)： | 34/43頁 |
| 文件大?。?/td> | 285K |
| 代理商： | XRT82L24IV |
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XRT82L24
QUAD E1 LINE TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
REV. 1.2.3
á
32
T
ABLE
14: I
NTEL
I
NTERFACE
T
IMING
S
PECIFICATIONS
SYMBOL
P
ARAMETER
M
IN
T
YP
M
AX
C
ONDITION
t
64
A8 - A0 Setup Time to ALE_AS
Low
4
ns
t
65
A8 - A0 Hold Time from ALE_AS
Low.
2
ns
Intel Type Read Operation
t
66
RDS_DS Pulse Width
260
ns
t
67
Data Valid from RDS_DS* Low.
240
ns
t
68
Data Bus Floating from
RDS_DS* High
2
ns
t
69
ALE to RD Time
4
ns
t
701
RD Time to "NOT READY" (e.g.,
RDY_DTCK toggling "Low")
145
ns
t
76
Minimum Time between Read
Burst Access (e.g., the rising
edge of RD to falling edge of RD)
60
ns
Intel Type Write Operations
t
71
Data Setup Time to WR_R/W
High
160
ns
t
72
Data Hold Time from WR_R/W
High
0
ns
t
73
High Time between Reads and/
or Writes
60
ns
t
74
ALE to WR Time
4
ns
t
77
Min Time between Write Burst
Access (e.g., the rising edge of
WR to the falling edge of WR)
60
ns
t
770
CS Assertion to falling edge of
WR_R/W
20
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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