參數(shù)資料
型號(hào)： XRT82L24IV
廠(chǎng)商： EXAR CORP
元件分類(lèi)： 數(shù)字傳輸電路
英文描述： QUAD E1 LINE TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
中文描述： DATACOM, PCM TRANSCEIVER, PQFP100
封裝： 14 X 14 MM, 1.40 MM HEIGHT, TQFP-100
文件頁(yè)數(shù)： 31/43頁(yè)
文件大小： 285K
代理商： XRT82L24IV
á
XRT82L24
QUAD E1 LINE TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
REV. 1.2.3
29
T
ABLE
12: C
HANNEL
M
ASK
R
EGISTER
C
HANNEL
M
ASK
R
EGISTER
P
ARALLEL
P
ORT
A
DDRESS
C
HANNEL
0: 0011
P
ARALLEL
P
ORT
A
DDRESS
C
HANNEL
1: 0110
P
ARALLEL
P
ORT
A
DDRESS
C
HANNEL
2: 1001
P
ARALLEL
P
ORT
A
DDRESS
C
HANNEL
3: 1100
B
IT
N
O
.
N
AME
F
UNCTION
R
EGISTER
T
YPE
R
ESET
V
ALUE
7
--
This bit is Reserved.
R/W
0
6
--
This bit is Reserved.
R/W
0
5
--
This bit is Reserved.
R/W
0
4
--
This bit is Reserved.
R/W
0
3
DMOnIS
Driver Monitor Output Interrupt Status:
Writing a "1" to this bit enables DMO alarm interrupt gener-
ation.
R/W
0
2
LOSnIS
Loss of Signal Interrupt Status:
Writing a "1" to this bit enables LOS alarm interrupt gener-
ation.
R/W
0
1
LCVnIS
Line Code Violation Interrupt Status:
Writing a "1" to this bit enables LCV interrupt generation.
R/W
0
0
TCKLnIS
Transmit Clock Loss Interrupt Status:
Writing a "1" to this bit enables TxClk clock loss interrupt
generation.
R/W
0
N
OTE
: n = channel number 0 to 3.
N
OTE
:
Register Type Abrbreviation:
R
= Read Only,
R/W
= Read or Write,
RUR
= Reset Upon Read
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PDF描述
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