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參數(shù)資料
| 型號： | TSB82AA2I |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | 1394b OHCI-LYNX CONTROLLER |
| 中文描述： | 的1394b OHCI的山貓控制器 |
| 文件頁數(shù)： | 34/104頁 |
| 文件大?。?/td> | 461K |
| 代理商： | TSB82AA2I |
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314
3.17 OHCI Control Register
The OHCI control register is defined by the
1394 Open Host Controller Interface Specification
and provides a bit for
big endian PCI support. See Table 315 for a complete description of the register contents.
Bit
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
Name
OHCI control
Type
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
Default
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Bit
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Name
OHCI control
Type
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R/W
Default
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Register:
Type:
Offset:
Default:
OHCI control
Read/Write
40h
0000 0000h
Table 315. OHCI Control Register Description
BIT
FIELD NAME
TYPE
DESCRIPTION
311
RSVD
R
Reserved. Bits 311 return 0s when read.
0
GLOBAL_SWAP
R/W
When bit 0 is set to 1, all quadlets read from and written to the PCI interface are byte-swapped (big
endian). This bit is loaded from serial EEPROM and must be cleared to 0 for normal operation.
3.18 Capability ID and Next Item Pointer Register
The capability ID and next item pointer register identifies the linked-list capability item and provides a pointer to the
next capability item, respectively. See Table 316 for a complete description of the register contents.
Bit
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Name
Capability ID and next item pointer
Type
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
Default
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
Register:
Type:
Offset:
Default:
Capability ID and next item pointer
Read-only
44h
0001h
Table 316. Capability ID and Next Item Pointer Register Description
BIT
FIELD NAME
TYPE
DESCRIPTION
158
NEXT_ITEM
R
Next item pointer. The TSB82AA2 device supports only one additional capability that is
communicated to the system through the extended capabilities list; therefore, this field returns 00h
when read.
70
CAPABILITY_ID
R
Capability identification. This field returns 01h when read, which is the unique ID assigned by the PCI
SIG for PCI power-management capability.
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