參數(shù)資料
型號： TDAT04622
英文描述： TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces
中文描述： TDAT的SONET / SDH 155/622/2488 Mbits /秒數(shù)據(jù)接口
文件頁數(shù)： 64/310頁
文件大小： 4628K
代理商： TDAT04622
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36
Agere Systems Inc.
Data Sheet
May 2001
155/622/2488 Mbits/s Data Interface
TDAT042G5 SONET/SDH
Pin Information
(continued)
Table 5
.
Pin Descriptions
—
Enhanced UTOPIA Interface Signals
(continued)
Pin
AL9
AP21
AK33
V33
Symbol
RxPA[D]
RxPA[C]
RxPA[B]
RxPA[A]
Type
3.3 V
I/O
O
Name/Description
Receive Cell/Packet Available.
This signal indicates when the
TDAT042G5 receive FIFO can send data to the master device.
The RxPA[D:A] signal behavior depends on the provisioned low
watermark in the UTOPIA interface.
I
One-Cycle Delay Mode.
This mode follows the UTOPIA Level
2 Standard. The RxPA response occurs one cycle after the
address is polled. RxENB is asserted to activate the selected
PHY. RxDATA and RxSOP are output one cycle after RxENB is
sampled active by the PHY device.
I
Two-Cycle Delay Mode.
This mode follows the UTOPIA Level
3 baselined text*. The RxPA response occurs two cycles after
the address is polled. RxENB is asserted to activate the
selected PHY. RxDATA and RxSOP are output two cycles after
RxENB is sampled active by the PHY device.
I
RxPA[D:A] Assertion.
RxPA[D:A] goes high (is asserted)
when the amount of data in the receive FIFO has reached or
exceeded the low watermark or there is end of packet (EOP)
resident in the FIFO.
I
RxPA[D:A] Deassertion.
In ATM mode, the RxPA[D:A] signal
goes low (is deasserted) when the FIFO has less than the low
threshold amount of data and there is no EOP inside the FIFO
(i.e., part of an ATM cell). Once the last byte of the current cell
is transmitted, and if the amount of data within the FIFO is still
less than the low threshold, RxPA[D:A] is deasserted.
In packet mode, the RxPA[D:A] signal goes low (is deasserted)
when the FIFO has less than the low threshold amount of data
and there is no EOP inside the FIFO.
Once the data transfer begins (since the amount of data has
reached or exceeded the low watermark), and if there is no
EOP below the low threshold (i.e., a long packet), the RxPA
signal is deasserted when the FIFO is drained by the UTOPIA
master device. In this case, the master must closely monitor the
RxPA[D:A] signals and use these signals as data valid indica-
tors to ensure that bad data is not read from the TDAT042G5.
TDAT042G5 will deassert the RxPA[D:A] signal immediately
when the FIFO is drained.
* ATM Forum Technical Committee, UTOPIA Level 3, STR-PHY-UL3-01.00, July
1999.
(See further description on next page.)
相關(guān)PDF資料
PDF描述
TDAT042G51A-3BLL1 TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces
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參數(shù)描述
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TDAT12622-BA23-DB 制造商:LSI Corporation 功能描述:SONET/SDH Interface 792-Pin BGA
TDAT161G2-BA23 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
TDAT162G52 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
TDAT162G52-3BA 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
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