參數(shù)資料
型號： TDAT04622
英文描述： TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces
中文描述： TDAT的SONET / SDH 155/622/2488 Mbits /秒數(shù)據(jù)接口
文件頁數(shù)： 61/310頁
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代理商： TDAT04622
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Agere Systems Inc.
33
Data Sheet
May 2001
155/622/2488 Mbits/s Data Interface
TDAT042G5 SONET/SDH
Pin Information
(continued)
Table 5
.
Pin Descriptions
—
Enhanced UTOPIA Interface Signals
(continued)
Pin
AN17
AL29
AA31
J31
Symbol
TxEOP[D]
TxEOP[C]
TxEOP[B]
TxEOP[A]
Type
3.3 V
I/O
I
Name/Description
(5 V tolerant)
Transmit End of Packet.
These pins are used only in U2+
and U3+ (packet) modes. This signal indicates that the last
word of a packet is on the TxDATA[D:A][15:0] bus.
TxEOP[D:A] is valid only when TxENB[D:A] is asserted, and
is sampled on the rising edge of TxCLK[D:A].
In U3+ (32-bit mode), only the TxEOP[A] input pin of port A
is used to indicate the end of the incoming packet.
Transmit Error.
These pins are used only in U2+ and U3+
(packet) modes. TxERR[D:A] is only used in packet modes,
and indicates that the current packet is to be aborted and
discarded, if possible. TxERR[D:A] is only valid when
TxEOP[D:A] and TxENB[D:A] are asserted, and is sampled
on the rising edge of TxCLK[D:A].
AM18
AM30
AA35
H32
TxERR[D]
TxERR[C]
TxERR[B]
TxERR[A]
3.3 V
(5 V tolerant)
I
In U3+ (32-bit mode), the TxERR[A] and the TxERR[B] input
pin of port A is used to indicate an error on the incoming
packet.
Receive Address.
Receive address is driven to the MPHY
to poll and select the appropriate MPHY channel.
AP20
AL32
AL33
W32
W31
N31
N32
N33
N34
P31
P32
P33
P34
P35
R31
R32
R33
R34
R35
T32
T33
RxADDR[4]
RxADDR[3]
RxADDR[2]
RxADDR[1]
RxADDR[0]
RxDATA[A][15]
RxDATA[A][14]
RxDATA[A][13]
RxDATA[A][12]
RxDATA[A][11]
RxDATA[A][10]
RxDATA[A][9]
RxDATA[A][8]
RxDATA[A][7]
RxDATA[A][6]
RxDATA[A][5]
RxDATA[A][4]
RxDATA[A][3]
RxDATA[A][2]
RxDATA[A][1]
RxDATA[A][0]
3.3 V
(5 V tolerant)
I
Note:
The address for each channel is configured by the
microprocessor.
3.3 V
O
Receive Data Channel A.
Used to transport data out of the
UTOPIA PHY Rx block. RxDATA[A][15:0] is only valid when
RxENB[A] is asserted, and is updated on the rising edge of
RxCLK[A]. Note that RxDATA[A][15:0] is used in various
UTOPIA modes. In U2 or U2+, all 16 bits are valid. In U3 or
U3+ (8-bit mode), only bits 15 to 8 are valid.
In U3 or U3+ (32-bit mode), RxDATA[A][15:0] forms the most
significant 16 bits of the combined data bus (bits 31 to 16),
and RxDATA[B][15:0] forms the least significant 16 bits of the
combined data bus (bits 15 to 0).
Note:
[15:0] refers to a 16-bit data bus (15 = MSB, 0 = LSB).
相關(guān)PDF資料
PDF描述
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TE13005D Silicon NPN High Voltage Switching Transistor
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TEA1065T Versatile telephone transmission circuit with dialler interface
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TDAT12622-BA23-DB 制造商:LSI Corporation 功能描述:SONET/SDH Interface 792-Pin BGA
TDAT161G2-BA23 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
TDAT162G52 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
TDAT162G52-3BA 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
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