參數(shù)資料
型號(hào)： TDAT04622
英文描述： TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces
中文描述： TDAT的SONET / SDH 155/622/2488 Mbits /秒數(shù)據(jù)接口
文件頁數(shù)： 239/310頁
文件大?。?/td> 4628K
代理商： TDAT04622
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Agere Systems Inc.
211
Data Sheet
May 2001
155/622/2488 Mbits/s Data Interface
TDAT042G5 SONET/SDH
Register Descriptions
(continued)
DE Registers
This section gives a brief description of each register bit and its functionality. All algorithms are described in the
main text of the document. The abbreviations after each register indicate if the register is read only (RO), read/write
(R/W), write only (WO), or clear-on-read or clear-on-write (COR/W).
0x indicates a hexadecimal value in the Reset Default column. Otherwise, the entry is binary. This is true for every
register table in the document.
Table 111. Register 0x1000: DE Macrocell Version Number (RO)
Reset default of register = 0x0001.
Table 112. Register 0x1001, 0x1002: DE Interrupts (0x1001 is RO, 0x1002 is RO and COR/W)
Reset default of registers = 0x0000.
Note:
Register 0x1001 is cleared by accessing the source register of the interrupt. The source register must be
read and cleared to clear these registers.
Address
(Hex)
1000
Bit #
Name
Function
Reset
Default
0x0001
15
—
0
DE_VERSION
Macrocell Version Number.
The version of the macrocell will
increment each time a change occurs to the macrocell
functionality.
Address
(Hex)
Bit #
Name
Function
Reset
Default
1001
15
—
5
—
Reserved.
These bits must be written to their reset default
value (00000000000).
000
0000
0000
0
4
DEINT_SDLMS
SDL Message Sent Interrupt.
Note:
This bit indicates that the SDL frame inserter is
experiencing an interrupt. This bit will
not
clear on a
read or a write of this register, but will clear when the
SDL SDLMSI register (0x1606, bit 0) is read.
These interrupts will generate a DE interrupt.
Channel Interrupt.
Active-high
interrupt bit on a per-
channel basis. These bits are the ORing of all interrupt bits
associated with the error counters described in registers
0x1100
—
0x111F (pages 238
—
page 143). The error counter
can be inhibited from contributing to the interrupt by setting the
appropriate mask bit in register
DEDINTM[0
—
3] (addresses 0x1180, 0x1182, 0x1184, 0x1186
on page 243).
The following interrupts will generate a DE interrupt:
Bit 0 corresponds to channel 0 interrupt.
3
—
0
DEINTCH[3:0]
Bit 1 corresponds to channel 1 interrupt.
Bit 2 corresponds to channel 2 interrupt.
Bit 3 corresponds to channel 3 interrupt.
Note:
This bit indicates that the channel is experiencing an
interrupt. This bit will
not
clear on a read or a write of
this register, but will clear when the counter interrupt
register DEDINTM[0
—
3] (addresses 0x1181, 0x1183,
0x1185, 0x1187 on page 244) is read or written.
0x0
相關(guān)PDF資料
PDF描述
TDAT042G51A-3BLL1 TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces
TE13004D Silicon NPN High Voltage Switching Transistor
TE13005D Silicon NPN High Voltage Switching Transistor
TEA1065 Versatile telephone transmission circuit with dialler interface
TEA1065T Versatile telephone transmission circuit with dialler interface
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TDAT12622-BA23 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
TDAT12622-BA23-DB 制造商:LSI Corporation 功能描述:SONET/SDH Interface 792-Pin BGA
TDAT161G2-BA23 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
TDAT162G52 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
TDAT162G52-3BA 制造商:AGERE 制造商全稱:AGERE 功能描述:MARS㈢2G5 P-Pro (TDAT162G52) SONET/SDH 155/622/2488 Mbits/s Data Interface
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