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參數(shù)資料
| 型號(hào)： | SYM53C825A |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個(gè)PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 72/225頁 |
| 文件大?。?/td> | 1237K |
| 代理商： | SYM53C825A |
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Signal Descriptions
MAD Bus Programming
4-12
SYM53C825A/825AE Data Manual
MAD Bus Programming
T he MAD(7-0) pins, in addition to serving as the address/data bus for the local memory interface, are
also used to program power-up options for the chip. A particular option is programmed by connecting a
4.7K
resistor between the appropriate MAD(x) pin and Vss. T he pull-down resistors require that HC or
HCT external components are used for the memory interface.
I
MAD(7) has no functionality. Do not place a pull-down resistor on this pin.
I
MAD(6) Subsystem Data configuration. Please refer to the table below for the different
configurations.
I
MAD(5) SCRIPT S RAM disable. Connecting a 4.7 K
resistor between MAD(5) and Vss disables
SCRIPT S RAM.
I
MAD(4) Subsystem Data configuration. Please refer to the tables below for the different
configurations.
Note: T he chip revisions before Revision G of the SYM53C825A (PCI Rev ID 0x14) do not support
different Subsystem Data Configurations. T he SSID and SSVID registers are hard wired to zero
values.
Table 4-11: Subsystem Data Configuration Table for the SYM53C825AE/ (PCI Rev ID 0x26)
Mode MAD Pins
Offset
Normal
4-hi, 6-hi
Read/Write
4-hi, 6-lo
Reserved
4-lo, 6-hi
Symbios, Inc.
4-lo, 6-lo
Vendor ID
00h
1000h
1000h
-
1000h
Device ID
02h
0003h
0003h
-
0003h
Subsystem Vendor ID
2Ch
1000h
0000h
-
0000h
Subsystem ID
2Eh
1000h
0000h
-
0000h
Table 4-12: Subsystem Data Configuration Table for the SYM53C825A/ (PCI Rev ID 0x14 ), Revision G Only
Mode MAD Pins
Offset
Normal
4-hi, 6-hi
Read/Write
4-hi, 6-lo
Reserved
4-lo, 6-hi
Symbios, Inc.
4-lo, 6-lo
Vendor ID
00h
1000h
1000h
-
1000h
Device ID
02h
0003h
0003h
-
0003h
Subsystem Vendor ID
2Ch
0000h
0000h
-
1000h
Subsystem ID
2Eh
0000h
0000h
-
1000h
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