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參數(shù)資料
| 型號： | PTM1300FBEA |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | Battery Monitor and Charge Controller |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA292 |
| 封裝： | PLASTIC, SOT-553-1, BGA-292 |
| 文件頁數(shù)： | 239/533頁 |
| 文件大小： | 6857K |
| 代理商： | PTM1300FBEA |
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Philips Semiconductors
I2C Interface
PRODUCT SPECIFICATION
16-5
served by software, and the hardware I
2
C interface is
disconnected from the SCL and SDA pins. Refer to
Figure 16-3
for a clarification of the principles involved.
Software mode is by default disabled after boot. Soft-
ware
mode
is
enabled
IIC_CR.SW_MODE_EN. At that point, the SCL and SDA
pins can be controlled by the IIC_CR SDA_OUT and
SCL_OUT bits. Writing a ‘1’ to either bit causes the cor-
responding pin to become active, i.e. be pulled low. The
SDA and SCL lines are open-collector outputs, and can
hence also be pulled low by external devices. The actual
pin state can be observed by software by examining
IIC_SR SDA_STAT and SCL_STAT bits. A 1 in these
MMIO bits indicates that the corresponding pin is cur-
rently pulled low.
By appropriate software, possibly using a timer interrupt,
full I
2
C functionality can be implemented using this
mechanism.
by
writing
a
‘1’
to
16.6
I
2
C HARDWARE OPERATION MODE
Hardware operation of I
2
C is the default mode after boot.
The TM1300 I
2
C hardware interface operates in one of
two modes:
1. Master-transmitter (to write data to a slave)
2. Master-receiver (to read data from a slave)
As a master, the I
2
C logic will generate all the serial clock
pulses and the START and STOP bus conditions. The
START and STOP bus conditions are shown in
Figure 16-4
. A transfer is ended with a STOP condition
or a repeated START condition. Since a repeated
START condition is also the beginning of the next serial
transfer, the I
2
C bus will not be released.
Note:
The I
2
C interface on TM1300 will operate as a
master ONLY!
The number of bytes transferred between the START
and STOP conditions from transmitter to receiver is not
limited. Each 8-bit data byte is followed by one acknowl-
edge bit. The transmitter releases the SDA line which will
pull-up to a HIGH level during the acknowledge bit time.
The receiver acknowledges by pulling the data line LOW
SCL
SDA
hardware
DATA
HIWAY
open drain
scl_stat
scl_out
I2C
D Q
sda_stat
sda_out
tribuf
tribuf
sw_mode_en
sw_mode_en
buf
open drain
buf
D Q
Figure 16-3. I
2
C
software mode only logic
SDA
SCL
S
P
START
STOP
Figure 16-4. START and STOP Conditions on I
2
C
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PTM1300 | Programmable Media Processor |
| PTM1300AEBEA | Programmable Media Processor |
| PTN3331 | High speed differential line driver |
| PTN3332 | High speed differential line receiver |
| PTN3332D | High speed differential line receiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PTM1404 NC199 | 制造商:Alpha Wire Company 功能描述:CBL 4COND 14AWG NC 5000=5000' |
| PTM1404-NC199 | 制造商:Alpha Wire 功能描述: |
| PTM1604 NC001 | 制造商:Alpha Wire Company 功能描述:CBL 4COND 16AWG NC 1000' |
| PTM1604 NC005 | 制造商:Alpha Wire Company 功能描述:CBL 4COND 16AWG NC 100' |
| PTM1604-NC199 | 制造商:Alpha Wire 功能描述: |
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