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參數(shù)資料
| 型號(hào)： | PCA5010H |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Pager baseband controller |
| 中文描述： | 傳呼機(jī)基帶控制器 |
| 文件頁數(shù)： | 21/112頁 |
| 文件大?。?/td> | 627K |
| 代理商： | PCA5010H |
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1998 Nov 02
21
Philips Semiconductors
Product specification
Pager baseband controller
PCA5010
6.8.2
T
IMING
The timing of the I
2
C-bus interface is based on the internal
6 MHz clock. The phases of this clock divided-by-4 are
used as a reference in the 400 kHz mode and
divided-by-16 in the 100 kHz mode. In the following
context ‘T’ (333 ns or 1.33
μ
s) denotes a single phase of
this clock.
The transfer of a single bit lasts 9 T. SCL is HIGH for 5 T.
When receiving data, the PCA5010 samples the SDA line
after 3 T while SCL is HIGH.
The implemented I
2
C-bus Interface operates according to
the timing diagram in Fig.9.
The open-drain I
2
C-bus outputs are implemented as slew
rate controlled driver stages, to minimize the negative
impact of I
2
C-bus activity on the pager sensitivity while the
pager is receiving. Typical waveforms on P1.7 (SDA) and
P1.6 (SCL) are shown in Fig.10.
Because SDA and SCL are open-drain type I/Os, only the
falling edge is determined by the driver characteristics.
The static sink current when driving LOW and the slope of
the rising edges are determined by the capacitive I
2
C-bus
load and its resistive termination (pull-up to V
DD
).
Fig.9 Timing of the I
2
C-bus interface.
handbook, full pagewidth
MGR337
3T
4T
START
SCL
SDA
STOP
5T
2T
2T
2T
TX bit
2T
2T
5T
2T
2T
3T
2T
RX bit
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PCA82C200 | STAND-ALONE CAN-CONTROLLER |
| PCA82C200P | STAND-ALONE CAN-CONTROLLER |
| PCA82C200T | STAND-ALONE CAN-CONTROLLER |
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| PCA82C250U | CAN controller interface |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| PCA503HU320 | 制造商:ADAM-TECH 制造商全稱:Adam Technologies, Inc. 功能描述:ZIF FLEX CIRCUIT CONNECTOR |
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