參數(shù)資料
型號: MQ83C154XXX-16/883D
廠商: TEMIC SEMICONDUCTORS
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQFP44
文件頁數(shù): 79/204頁
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代理商: MQ83C154XXX-16/883D
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17
ATtiny40 [DATASHEET]
8263B–AVR–01/2013
Some of the status flags are cleared by writing a logical one to them. Note that CBI and SBI instructions will only
operate on the specified bit, and can therefore be used on registers containing such status flags. The CBI and SBI
instructions work on registers in the address range 0x00 to 0x1F, only.
The I/O and Peripherals Control Registers are explained in later sections.
5.4
Register Description
5.4.1
RAMAR – RAM Address Register
Bits 7:0 – RAMAR[7:0]: RAM Address
The RAMAR register contains the RAM address bits. The RAM data bytes are addressed linearly in the range
0..255. The initial value of RAMAR is undefined and a proper value must be therefore written before the RAM may
be accessed.
5.4.2
RAMDR – RAM Data Register
Bits 7:0 – RAMDR[7:0]: RAM Data
For the RAM write operation, the RAMDR register contains the RAM data to be written to the RAM in address given
by the RAMAR register. For the RAM read operation, the RAMDR contains the data read out from the RAM at the
address given by RAMAR.
6.
Clock System
Figure 6-1 presents the principal clock systems and their distribution in ATtiny40. All of the clocks need not be
active at a given time. In order to reduce power consumption, the clocks to modules not being used can be halted
by using different sleep modes and power reduction register bits, as described in “Power Management and Sleep
Modes” on page 23. The clock systems is detailed below.
Bit
76543210
RAMAR7
RAMAR6
RAMAR5
RAMAR4
RAMAR3
RAMAR2
RAMAR1
RAMAR0
RAMAR
Read/Write
R/W
Initial Value
XXXXXXXX
Bit
76543210
RAMDR7
RAMDR6
RAMDR5
RAMDR4
RAMDR3
RAMDR2
RAMDR1
RAMDR0
RAMDR
Read/Write
R/W
Initial Value
XXXXXXXX
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