- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄45353 > MPC823CZT25 (MOTOROLA INC) 32-BIT, RISC PROCESSOR, PBGA256 PDF資料下載
參數(shù)資料
| 型號(hào)： | MPC823CZT25 |
| 廠商： | MOTOROLA INC |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, RISC PROCESSOR, PBGA256 |
| 封裝： | 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256 |
| 文件頁(yè)數(shù)： | 1254/1407頁(yè) |
| 文件大?。?/td> | 13074K |
| 代理商： | MPC823CZT25 |
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Communication Processor Module
MOTOROLA
MPC823 USER’S MANUAL
16-341
SCC2
COMMUNICATION
16
PROCESSOR
MODULE
10. Write RFCR and TFCR with 0x18 for normal operation.
11. Write MRBLR with the maximum number of bytes per receive buffer. For this case,
assume 1,520 bytes, so MRBLR = 0x05F0. In this example, the user wants to receive
an entire frame into one buffer, so the MRBLR value is chosen to be the first value
larger than 1,518 that is evenly divisible by four.
12. Write C_PRES with 0xFFFFFFFF to comply with 32-bit CCITT-CRC.
13. Write C_MASK with 0xDEBB20E3 to comply with 32-bit CCITT-CRC.
14. Clear CRCEC, ALEC, and DISFC for clarity.
15. Write PAD with 0x8888 for the pad value.
16. Write RET_LIM with 0x000F.
17. Write MFLR with 0x05EE to make the maximum frame size 1,518 bytes.
18. Write MINFLR with 0x0040 to make the minimum frame size 64 bytes.
19. Write MAXD1 and MAXD2 with 0x05EE to make the maximum DMA count 1,518
bytes.
20. Clear GADDR1–GADDR4. The group hash table is not used.
21. Write PADDR1_H with 0x0380, PADDR1_M with 0x12E0, and PADDR1_L with
0x5634 to configure the physical address 8003E0123456.
22. Write P_Per with 0x0000. It is not used.
23. Clear IADDR1–IADDR4. The individual hash table is not used.
24. Clear TADDR_H, TADDR_M, and TADDR_L for clarity.
25. Initialize the RX buffer descriptor and assume the RX data buffer is at 0x00001000 in
main memory. Write 0xB000 to Rx_BD_Status, 0x0000 to Rx_BD_Length (optional),
and 0x00001000 to Rx_BD_Pointer.
26. Initialize the TX buffer descriptor and assume the TX data frame is at 0x00002000 in
main memory and contains fourteen 8-bit characters (destination and source
addresses plus the type field). Write 0xFC00 to Tx_BD_Status, add PAD to the frame
and generate a CRC. Then write 0x000D to Tx_BD_Length and 0x00002000 to
Tx_BD_Pointer.
27. Write 0xFFFF to the SCCE–Ethernet to clear any previous events.
28. Write 0x001A to the SCCM–Ethernet to enable the TXE, RXF, and TXB interrupts.
29. Write 0x20000000 to the CIMR so that SCC2 can generate a system interrupt. The
CICR should also be initialized.
30. Write 0x00000000 to the GSMR_H to enable normal operation of all modes.
31. Write 0x1088000C to the GSMR_L to configure the CTS (CLSN) and CD (RENA) pins
to automatically control transmission and reception (DIAG field) and the Ethernet
mode. TCI is set to allow more setup time for the EEST to receive the MPC823
transmit data. TPL and TPP are set for Ethernet requirements. The DPLL is not used
with Ethernet. Notice that the transmitter (ENT) and receiver (ENR) have not been
enabled yet.
32. Write 0xD555 to the DSR.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC823ZT25 | 32-BIT, RISC PROCESSOR, PBGA256 |
| MPC8241LVR200X | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA357 |
| MPC8241LVR166X | 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357 |
| MPC8241LVR266D | 32-BIT, 266 MHz, RISC PROCESSOR, PBGA357 |
| MPC8241LZQ166D | 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC823ELD | 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823ELE | 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823EPAD | 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823EPAK | 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823ERD | 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
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