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參數(shù)資料
| 型號： | MD80C52TXXX-16SBD |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40 |
| 文件頁數(shù)： | 82/604頁 |
| 文件大?。?/td> | 22337K |
| 代理商： | MD80C52TXXX-16SBD |
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172
42073A-MCU Wireless-02/13
ATmega2564/1284/644RFR2
The Interrupt Status Register indicates pending interrupt requests. If the corresponding
interrupt mask bit is set, an interrupt service routine is called and the status bit is
cleared automatically. It is also possible to clear the status bit by writing "1" to the
selected bit.
Bit 7:5 – Res2:0 - Reserved Bit
This bit is reserved for future use. The result of a read access is undefined. The register
bit must always be written with the reset value.
Bit 4 – IRQSBO - Backoff Slot Counter IRQ
This interrupt is generated every 320 s, that means every 20 symbols.
Bit 3 – IRQSOF - Symbol Counter Overflow IRQ
This interrupt is generated when the 32 bit counter turns from 0xFFFFFFF to
0x00000000.
Bit 2 – IRQSCP3 - Compare Unit 3 Compare Match IRQ
This interrupt indicates a compare match on compare unit 3.
Bit 1 – IRQSCP2 - Compare Unit 2 Compare Match IRQ
This interrupt indicates a compare match on compare unit 2.
Bit 0 – IRQSCP1 - Compare Unit 1 Compare Match IRQ
This interrupt indicates a compare match on compare unit 1.
10.11.38 SCIRQM – Symbol Counter Interrupt Mask Register
Bit
7
6
5
4
3
2
1
0
NA ($DF)
Res2
Res1
Res0
IRQMBO IRQMOF IRQMCP3 IRQMCP2 IRQMCP1
SCIRQM
Read/Write
R
RW
Initial Value
0
The Interrupt Mask Register is used to enable corresponding interrupts. After reset all
interrupts are disabled. Disabled interrupts are still captured in the interrupt status
register SCIRQS, but no interrupt is requested. Before enabling an interrupt, the
corresponding interrupt status bit should be cleared by writing a 1. If the status bit is set
and the IRQ gets enabled, the IRQ handler is called immediately.
Bit 7:5 – Res2:0 - Reserved Bit
This bit is reserved for future use. The result of a read access is undefined. The register
bit must always be written with the reset value.
Bit 4 – IRQMBO - Backoff Slot Counter IRQ enable
This bit enables the SCNT_BACKOFF interrupt.
Bit 3 – IRQMOF - Symbol Counter Overflow IRQ enable
This bit enables the SCNT_OVFL interrupt.
Bit 2 – IRQMCP3 - Symbol Counter Compare Match 3 IRQ enable
This bit enables the SCNT_CMP3 interrupt.
Bit 1 – IRQMCP2 - Symbol Counter Compare Match 2 IRQ enable
This bit enables the SCNT_CMP2 interrupt.
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PDF描述 |
|---|---|
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| MC80C52XXX-25P883D | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CDIP40 |
| MR80C52EXXX-25SCD | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQCC44 |
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參數(shù)描述 |
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| MD80C862 | 制造商:Intel 功能描述:PROCESSOR:MICRO-PROCESSOR |
| MD80C86-2 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor |
| MD80C86-2/883 | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube 制造商:Rochester Electronics LLC 功能描述:CPU 16BILT 5V CMOS 8MHZ 40CDIP - Bulk |
| MD80C86-2/B | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube |
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