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參數(shù)資料
| 型號： | MC56F8323 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | 16-bit Hybrid Controller(16位混合控制器) |
| 中文描述： | 16位混合控制器（16位混合控制器） |
| 文件頁數(shù)： | 83/132頁 |
| 文件大小： | 2202K |
| 代理商： | MC56F8323 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁當(dāng)前第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁
Register Descriptions
56F8323 Technical Data
Preliminary
83
6.5.5
This read-only register displays the least significant half of the JTAG ID for the chip. This register
reads $001D.
Least Significant Half of JTAG ID (SIM_LSH_ID)
Figure 6-7 Least Significant Half of JTAG ID (SIM_LSH_ID)
6.5.6
Most of the pins on the chip have on-chip pull-up resistors. Pins which can operate as GPIO can
have these resistors disabled via the GPIO function. Non-GPIO pins can have their pull-ups
disabled by setting the appropriate bit in this register. Disabling pull-ups is done on a
peripheral-by-peripheral basis (for pins not muxed with GPIO). Each bit in the register (see
Figure 6-8
) corresponds to a functional group of pins. See
Table 2-2
to identify which pins can
deactivate the internal pull-up resistor.
SIM Pull-up Disable Register (SIM_PUDR)
Figure 6-8 SIM Pull-up Disable Register (SIM_PUDR)
6.5.6.1
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
Reserved—Bits 15–12
6.5.6.2
This bit controls the pull-up resistors on the RESET pin.
RESET—Bit 11
6.5.6.3
This bit controls the pull-up resistors on the IRQA pin.
IRQ—Bit 10
6.5.6.4
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
Reserved—Bits 9–4
6.5.6.5
This bit controls the pull-up resistors on the TRST, TMS, and TDI pins.
JTAG—Bit 3
6.5.6.6
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
Reserved—Bits 2–0
Base + $7
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
1
0
0
0
0
0
0
0
0
0
1
1
1
0
1
Write
RESET
0
0
0
0
0
0
0
0
0
0
0
1
1
1
0
1
Base + $8
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
0
0
0
RESET
IRQ
0
0
0
0
0
0
JTAG
0
0
0
Write
RESET
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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