參數(shù)資料
型號： MC56F8323
廠商： 飛思卡爾半導體(中國)有限公司
英文描述： 16-bit Hybrid Controller(16位混合控制器)
中文描述： 16位混合控制器（16位混合控制器）
文件頁數(shù)： 112/132頁
文件大?。?/td> 2202K
代理商： MC56F8323
112
56F8323 Technical Data
Preliminary
10.9 Serial Peripheral Interface (SPI) Timing
Table 10-18 SPI Timing
1
Operating Conditions: V
SS
= V
SSA_ADC
= 0V, V
DD_IO
= V
DDA_ADC
= V
DDA_OSC_PLL
= 3.0–3.6V, T
A
= –40
°
to +125
°
C, C
L
≤
50pF, f
op
= 60MHz
1.
Parameters listed are guaranteed by design.
Characteristic
Symbol
Min
Max
Unit
See Figure(s)
Cycle time
Master
Slave
t
C
50
50
—
—
ns
ns
10-9
,
10-10
,
10-11
,
10-12
Enable lead time
Master
Slave
t
ELD
—
25
—
—
ns
ns
10-12
Enable lag time
Master
Slave
t
ELG
—
100
—
—
ns
ns
10-12
Clock (SCK) high time
Master
Slave
t
CH
17.6
25
—
—
ns
ns
10-9
,
10-10
,
10-11
,
10-12
Clock (SCK) low time
Master
Slave
t
CL
24.1
25
—
—
ns
ns
10-12
Data set-up time required for inputs
Master
Slave
t
DS
20
0
—
—
ns
ns
10-9
,
10-10
,
10-11
,
10-12
Data hold time required for inputs
Master
Slave
t
DH
0
2
—
—
ns
ns
10-9
,
10-10
,
10-11
,
10-12
Access time (time to data active from
high-impedance state)
Slave
t
A
4.8
15
ns
10-12
Disable time (hold time to high-impedance
state)
Slave
t
D
3.7
15.2
ns
10-12
Data Valid for outputs
Master
Slave (after enable edge)
t
DV
—
—
4.5
20.4
ns
ns
10-9
,
10-10
,
10-11
,
10-12
Data invalid
Master
Slave
t
DI
0
0
—
—
ns
ns
10-9
,
10-10
,
10-11
,
10-12
Rise time
Master
Slave
t
R
—
—
11.5
10.0
ns
ns
10-9
,
10-10
,
10-11
,
10-12
Fall time
Master
Slave
t
F
—
—
9.7
9.0
ns
ns
10-9
,
10-10
,
10-11
,
10-12
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
.
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PDF描述
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