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參數(shù)資料
| 型號： | M30245MC-XXXGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 237/268頁 |
| 文件大?。?/td> | 2520K |
| 代理商： | M30245MC-XXXGP |
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M30245 Group
Watchdog Timer
Rev.2.00
Oct 16, 2006
page 68 of 264
REJ03B0005-0200
Watchdog Timer
The watchdog timer can detect a runaway program. It is a 15-bit counter that decrements using the clock derived
from dividing the BCLK by the prescaler. A watchdog timer interrupt is generated when an underflow occurs in the
watchdog timer. The watchdog timer interrupt is a non-maskable interrupt.
When XIN is selected for BCLK, bit 7 (WDC7) of the watchdog timer control register (address 000F16) selects the
prescaler divide ratio to be either 16 or 128. When XCIN is selected for BCLK, the prescaler divide ratio is set to 2
regardless of WDC7. The watchdog timer cycle can be calculated as follows:
When XIN chosen for BCLK:
Watchdog timer period = prescaler dividing ratio (16 or 128) X Watchdog timer count (32768)
BCLK
When XCIN chosen for BCLK:
Watchdog timer period = prescaler dividing ratio (2) X Watchdog timer count (32768)
BCLK
Example:
When BCLK is 12 MHz and the prescaler divide ratio is set to 16, the monitor timer cycle is approximately 43.69 ms.
The watchdog timer is initialized by writing to the watchdog timer start register (address 000E16), and when a
watchdog timer interrupt request is generated.
The prescaler is initialized only when the microcomputer is reset. After a reset, the watchdog timer and prescaler
are both stopped. The count is started by writing to the watchdog timer start register (address 000E16).
The watchdog timer and the prescaler stop in stop mode, wait mode, and hold state. After exiting these modes,
counting starts from the remaining value. Figure 1.42 shows the block diagram of the watchdog timer. Figure 1.43
shows the watchdog timer-related registers.
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