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參數(shù)資料
| 型號(hào)： | M30245MC-XXXGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件頁(yè)數(shù)： | 11/268頁(yè) |
| 文件大?。?/td> | 2520K |
| 代理商： | M30245MC-XXXGP |
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M30245 Group
DMA
Rev.2.00
Oct 16, 2006
page 106 of 264
REJ03B0005-0200
Internal factors
Except the DMA request factors triggered by software, the timing for the DMA request bit to turn to "1" due to an
internal factor is the same as the timing for the interrupt request bit of the interrupt control register to turn to "1" due to
several factors.
Turning the DMA request bit to "1" due to an internal factor is timed to be effected immediately before the transfer
starts.
External factors
An external factor is a DMA request caused from the INTi pin input edge ("i" reflects the DMAC channel used).
Selecting the INTi pins as external factors using the DMA request factor selection bit causes input from these pins to
become the DMA transfer request signals.
The timing for the DMA request bit to turn to "1" when an external factor is selected synchronizes with the signal's edge
applicable to the function specified by the DMA request factor selection bit (synchronizes with the trailing edge of the
input signal to each INTi pin, for example).
With an external factor selected, the DMA request bit is timed to turn to "0" immediately before data transfer starts
similarly to the state in which an internal factor is selected.
Priorities of the channels and DMA transfer timing
If a DMA transfer request signal falls on a single sampling cycle (a sampling cycle means one period from the leading
edge to the trailing edge of BCLK), the DMA request bits of applicable channels concurrently turn to "1". If the channels
are active at that moment, DMA0 is given a high priority to start data transfer. When DMA0 finishes data transfer, it gives
the bus right to the CPU. When the CPU finishes single bus access, then DMA1 starts data transfer and gives the bus
right to the CPU. The DMA priority levels are:
DMA0 > DMA1 > DMA2 > DMA3
Figure 1.74 is an example of DMA transfer effected by external factors when DMA0 and DMA1 requests occur in the
same sampling cycle.
Figure 1.74. An example of DMA transfer by external factors
DMA0
DMA1
DMA0
request bit
DMA1
request bit
CPU
INT0
INT1
Bus
control
Example of DMA transmission that is carried out in minimum cycles
at the time DMA transmission occur concurrently.
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M30245FCGP | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP100 |
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| M30260M3A-XXXGP-U5 | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP48 |
| M30260M8A-XXXGP-U5 | 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP48 |
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參數(shù)描述 |
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| M30245MGGP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
| M30245MG-XXXFP | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
| M30245MG-XXXGF | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
| M30245MG-XXXGP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
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