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參數(shù)資料
| 型號： | CL-PS7110 |
| 廠商： | Cirrus Logic, Inc. |
| 英文描述： | Low-Power System-on-a-Chip |
| 中文描述： | 低功耗系統(tǒng)級晶片 |
| 文件頁數(shù)： | 68/82頁 |
| 文件大?。?/td> | 1101K |
| 代理商： | CL-PS7110 |
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DATA BOOK v1.5
May 1997
68
ELECTRICAL SPECIFICATIONS
CL-PS7110
Low-Power System-on-a-Chip
Figure 4-6. DRAM CAS-Before-RAS Refresh Cycle
NOTES:
1)
t
CSA
(CAS set-up time) = 25 ns minimum at MCLK = 18.432 MHz
t
RAS
(RAS pulse width) = 80 ns minimum at MCLK = 18.432 MHz
t
RC
(cycle time) = 160 ns minimum at MCLK = 18.432 MHz
When DRAMs are placed in self-refresh (entering standby) the same timings apply, but t
RAS
is extended
indefinitely.
2)
3)
4)
HELD
CAS[3:0]
D[31:0]
NMOE
DRA[12:0]
RAS[3:0]
DRAM CAS-before-RAS refresh cycle (MCLK shown for reference only)
t
RAS
MCLK
ROW
COL
t
CSA
NMWE
HELD
t
RC
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PDF描述 |
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