參數(shù)資料
型號： XRT84L38IB
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： DATACOM, FRAMER, PBGA388
封裝： 35 X 35 MM, PLASTIC, BGA-388
文件頁數(shù)： 7/453頁
文件大小： 2982K
代理商： XRT84L38IB
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XRT84L38
III
REV. 1.0.1
OCTAL T1/E1/J1 FRAMER
S MODE........................................................................................................................................................................ 181
C
LOCK
S
ELECT
R
EGISTER
(CSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
00H)................................................. 181
T
ABLE
36: S
IGNALS
FOR
DIFFERENT
T
RANSMIT
TIMING
SOURCES
................................................................................................... 182
T
RANSMIT
I
NTERFACE
C
ONTROL
R
EGISTER
(TICR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
20H)....................... 182
T
ABLE
37: T
HE
T
X
TS
B
[3:0]
BITS
WHEN
THE
T
RANSMIT
F
RACTIONAL
T1 I
NPUT
BIT
IS
SET
TO
DIFFERENT
VALUES
............................ 183
4.1.2.1 C
ONNECT
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
TO
THE
L
OCAL
T
ERMINAL
E
QUIPMENT
IF
T
RANSMIT
T
IMING
S
OURCE
= T
X
S
ER
C
LK
_
N
............................................................................................................................ 183
F
IGURE
23. I
NTERFACING
XRT84L38
TO
LOCAL
T
ERMINAL
E
QUIPMENT
WITH
T
X
S
ER
C
LK
_
N
AS
T
RANSMIT
T
IMING
S
OURCE
............ 184
F
IGURE
24. W
AVEFORMS
OF
THE
SIGNALS
THAT
CONNECT
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
TO
THE
LOCAL
T
ERMINAL
E
QUIPMENT
WITH
THE
T
RANSMIT
S
ERIAL
CLOCK
BEING
THE
T
IMING
S
OURCE
OF
THE
T
RANSMIT
S
ECTION
....................... 185
4.1.2.2 C
ONNECT
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
TO
THE
L
OCAL
T
ERMINAL
E
QUIPMENT
IF
THE
T
RANSMIT
T
IMING
S
OURCE
= OSCCLK.................................................................................................................................. 185
C
LOCK
S
ELECT
R
EGISTER
(CSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
00H)................................................. 186
F
IGURE
25. I
NTERFACING
XRT84L38
TO
THE
LOCAL
T
ERMINAL
E
QUIPMENT
WITH
THE
OSCCLK D
RIVEN
D
IVIDED
C
LOCK
AS
T
RANSMIT
T
IM
-
ING
S
OURCE
................................................................................................................................................................ 187
F
IGURE
26. W
AVEFORMS
OF
THE
SIGNALS
CONNECTING
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
TO
THE
LOCAL
T
ERMINAL
E
QUIPMENT
WITH
THE
OSCCLK D
RIVEN
D
IVIDED
CLOCK
AS
THE
TIMING
SOURCE
OF
THE
T
RANSMIT
S
ECTION
............... 188
4.1.2.3 C
ONNECT
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
TO
THE
L
OCAL
T
ERMINAL
E
QUIPMENT
FOR
L
OOP
-
TIM
-
ING
APPLICATIONS
.................................................................................................................................................. 188
C
LOCK
S
ELECT
R
EGISTER
(CSR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
00H).................................................. 189
F
IGURE
27. I
NTERFACING
XRT84L38
TO
LOCAL
T
ERMINAL
E
QUIPMENT
WITH
R
ECOVERED
R
ECEIVE
L
INE
C
LOCK
AS
T
RANSMIT
T
IMING
S
OURCE
...................................................................................................................................................................... 190
F
IGURE
28. W
AVEFORMS
OF
THE
SIGNALS
CONNECTING
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
TO
THE
LOCAL
T
ERMINAL
E
QUIPMENT
WITH
THE
R
ECOVERED
R
ECEIVE
L
INE
C
LOCK
BEING
THE
TIMING
SOURCE
OF
THE
T
RANSMIT
S
ECTION
......... 191
4.1.3 BRIEF DISCUSSION OF THE TRANSMIT HIGH-SPEED BACK-PLANE INTERFACE ........................................... 191
T
RANSMIT
I
NTERFACE
C
ONTROL
R
EGISTER
(TICR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
20H)....................... 191
T
ABLE
38: T
RANSMIT
M
ULTIPLEX
E
NABLE
BIT
AND
T
RANSMIT
I
NTERFACE
M
ODE
S
ELECT
[1:0]
BITS
WITH
THE
RESULTING
T
RANSMIT
B
ACK
-
PLANE
I
NTERFACE
DATA
RATES
.................................................................................................................................... 192
T
RANSMIT
M
ULTIPLEX
E
NABLE
B
IT
= 0...................................................................................................... 192
T
RANSMIT
M
ULTIPLEX
E
NABLE
B
IT
= 1...................................................................................................... 193
T
RANSMIT
I
NTERFACE
C
ONTROL
R
EGISTER
(TICR) (I
NDIRECT
A
DDRESS
= 0
XN
0H, 0
X
20H)........................ 193
4.1.3.1 T1 T
RANSMIT
I
NPUT
I
NTERFACE
- MVIP 2.048 MH
Z
........................................................................................... 194
T
ABLE
39: T
HE
MAPPING
OF
T1
FRAME
INTO
E1
FRAMING
FORMAT
................................................................................................ 194
F
IGURE
29. I
NTERFACING
XRT84L38
TO
THE
LOCAL
T
ERMINAL
E
QUIPMENT
USING
MVIP 2.048M
BIT
/
S
D
ATA
B
US
......................... 195
F
IGURE
30. T
IMING
D
IAGRAM
OF
THE
I
NPUT
S
IGNALS
TO
THE
F
RAMER
WHEN
RUNNING
AT
MVIP 2.048M
BIT
/
S
M
ODE
..................... 195
4.1.3.2 T1 T
RANSMIT
I
NPUT
I
NTERFACE
- 4.096 MH
Z
..................................................................................................... 195
T
ABLE
40: T
HE
MAPPING
OF
T1
FRAME
INTO
E1
FRAMING
FORMAT
................................................................................................ 196
F
IGURE
31. I
NTERFACING
XRT84L38
TO
THE
LOCAL
T
ERMINAL
E
QUIPMENT
USING
4.096M
BIT
/
S
D
ATA
B
US
................................... 197
F
IGURE
32. T
IMING
D
IAGRAM
OF
THE
I
NPUT
S
IGNALS
TO
THE
F
RAMER
WHEN
RUNNING
AT
4.096M
BIT
/
S
M
ODE
............................... 197
4.1.3.3 T1 T
RANSMIT
I
NPUT
I
NTERFACE
- 8.192 MH
Z
..................................................................................................... 197
T
ABLE
41: T
HE
MAPPING
OF
T1
FRAME
INTO
E1
FRAMING
FORMAT
................................................................................................ 198
F
IGURE
33. I
NTERFACING
XRT84L38
TO
THE
L
OCAL
T
ERMINAL
E
QUIPMENT
USING
8.192M
BIT
/
S
D
ATA
B
US
.................................. 199
F
IGURE
34. T
IMING
D
IAGRAM
OF
THE
I
NPUT
S
IGNALS
TO
THE
F
RAMER
WHEN
RUNNING
AT
8.192M
BIT
/
S
M
ODE
............................... 199
4.1.3.4 T1 T
RANSMIT
I
NPUT
I
NTERFACE
- M
ULTIPLEXED
12.352M
BIT
/
S
........................................................................... 199
F
IRST
O
CTET
OF
12.352M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 200
S
ECOND
O
CTET
OF
12.352M
BIT
/
S
D
ATA
S
TREAM
...................................................................................... 200
T
HIRD
O
CTET
OF
12.352M
BIT
/
S
D
ATA
S
TREAM
......................................................................................... 200
S
IXTH
O
CTET
OF
12.352M
BIT
/
S
D
ATA
S
TREAM
......................................................................................... 201
S
EVENTH
O
CTET
OF
12.352M
BIT
/
S
D
ATA
S
TREAM
.................................................................................... 201
E
IGHTH
O
CTET
OF
12.352M
BIT
/
S
D
ATA
S
TREAM
....................................................................................... 201
N
INETH
O
CTET
OF
12.352M
BIT
/
S
D
ATA
S
TREAM
....................................................................................... 201
F
IGURE
35. I
NTERFACING
XRT84L38
TO
THE
L
OCAL
T
ERMINAL
E
QUIPMENT
USING
B
IT
-M
ULTIPLEXED
12.352M
BIT
/
S
D
ATA
B
US
..... 202
F
IGURE
36. T
IMING
D
IAGRAM
OF
THE
I
NPUT
S
IGNALS
TO
THE
F
RAMER
WHEN
RUNNING
AT
12.352M
BIT
/
S
M
ODE
............................. 202
4.1.3.5 T1 T
RANSMIT
I
NPUT
I
NTERFACE
- B
IT
-M
ULTIPLEXED
16.384M
BIT
/
S
..................................................................... 202
F
IRST
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.......................................................................................... 203
N
INETH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
....................................................................................... 203
T
ENTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
........................................................................................ 203
T
HIRTEENTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
................................................................................ 204
F
OURTEENTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.............................................................................. 204
F
IFTEENTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.................................................................................. 204
S
IXTEENTH
O
CTET
OF
16.384M
BIT
/
S
D
ATA
S
TREAM
.................................................................................. 204
F
IGURE
37. I
NTERFACING
XRT84L38
TO
THE
L
OCAL
T
ERMINAL
E
QUIPMENT
USING
16.384M
BIT
/
S
D
ATA
B
US
................................ 205
相關(guān)PDF資料
PDF描述
XRT84V24 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT86L30 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT86L30IB Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT86SH221 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
XRT86SH221IB Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XRT84L38-L38PCI 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT84L38-SL38PCI 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT85L61 制造商:EXAR 制造商全稱:EXAR 功能描述:BITS (BUILDING INTEGRATED TIMING SUPPLY) CLOCK EXTRACTOR
XRT85L61_10 制造商:EXAR 制造商全稱:EXAR 功能描述:BITS (Building Integrated Timing Supply) Clock Extractor
XRT85L61ES 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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