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參數(shù)資料
| 型號： | XRT84L38IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA388 |
| 封裝： | 35 X 35 MM, PLASTIC, BGA-388 |
| 文件頁數(shù)： | 257/453頁 |
| 文件大?。?/td> | 2982K |
| 代理商： | XRT84L38IB |
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XRT84L38
237
REV. 1.0.1
OCTAL T1/E1/J1 FRAMER
data of Channel 0-3 are multiplexed onto the Receive Serial Data pin of Channel 0. Payload and signaling data
of Channel 4-7 are multiplexed onto the Receive Serial Data pin of Channel 4.
Free-running clocks of 16.384MHz are supplied to the Receive Serial Clock pin of Channel 0 and Channel 4 of
the framer. The Receive High-speed Back-plane Interface of the farmer provides data at rising edge of this
Receive Serial Clock. The local Terminal Equipment then latches incoming serial data at falling edge of the
clock.
The Receive High-speed Back-plane Interface maps four 1.544Mbit/s DS1 data streams into this 16.384Mbit/s
data stream as described below:
1.
The F-bit of four channels are repeated and grouped together to form the first octet of the multiplexed data
stream. The F-bit of Channel 0 is sent first, followed by F-bit of Channel 1 and 2. The F-bit of Channel 3 is
sent last. The table below shows bit-pattern of the first octet.
F
X
: F-bit of Channel X
2.
After the first octet of data is sent, the Receive High-speed Back-plane Interface should insert seven octets
(fifty-six bits) of "don't care" data into the outgoing data stream.
3.
Payload data of four channels are repeated and grouped together in a bit-interleaved way. The first pay-
load bit of Timeslot 0 of Channel 0 is sent first, followed by the first payload bit of Timeslot 0 of Channel 1
and 2. The first payload bit of Timeslot 0 of Channel 3 is sent last. After the first bits of Timeslot 0 of all four
channels are sent, it comes the second bit of Timeslot 0 of Channel 0 and so on. The table below demon-
strates how payload bits of four channels are mapped into the 16.384Mbit/s data stream.
XY: The Xth payload bit of Channel Y
4.
The Receive High-speed Back-plane Interface also multiplexed signaling bits with payload bits and sent
them together through the 16.384Mbit/s data stream. When the Receive High-speed Back-plane Interface
is sending the fifth payload bit of a particular channel, instead of sending it twice, it inserts the signaling bit
A of that particular channel. Similarly, the sixth payload bit of a particular channels is followed by the signal-
ing bit B of that channel; the seventh payload bit is followed by the signaling bit C; the eighth payload bit is
followed by the signaling bit D.
FIRST OCTET OF 16.384MBIT/S DATA STREAM
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
F
0
F
0
F
1
F
1
F
2
F
2
F
3
F
3
NINTH OCTET OF 16.384MBIT/S DATA STREAM
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
1
0
1
0
1
1
1
1
1
2
1
2
1
3
1
3
TENTH OCTET OF 16.384MBIT/S DATA STREAM
B
IT
0
B
IT
1
B
IT
2
B
IT
3
B
IT
4
B
IT
5
B
IT
6
B
IT
7
2
0
2
0
2
1
2
1
2
2
2
2
2
3
2
3
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT84V24 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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| XRT86L30IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT85L61ES | 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
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