參數(shù)資料
型號： ST7FLU05MAE
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO8
封裝： 0.150 INCH, LEAD FREE, PLASTIC, SOP-8
文件頁數(shù)： 75/124頁
文件大?。?/td> 2186K
代理商： ST7FLU05MAE
Obsolete
Product(s)
- Obsolete
Product(s)
Power saving modes
ST7LUS5, ST7LU05, ST7LU09
54/124
Figure 26.
AWUFH mode flowchart
1.
WDGHALT is an option bit. See option bytes in Section 14.1.1: Flash configuration for more details.
2.
Peripheral clocked with an external clock source can still be active.
3.
Only an AWUFH interrupt and some specific interrupts can exit the MCU from halt mode (such as external
interrupt). Refer to Table 15: Interrupt mapping on page 46 for more details.
4.
Before servicing an interrupt, the CC register is pushed on the stack. The I[1:0] bits of the CC register are
set to the current software priority level of the interrupt routine and recovered when the CC register is
popped.
Reset
Interrupt(3)
Y
N
Y
CPU
Main OSC
Peripherals(2)
I[1:0] bits
Off
10
Off
Fetch reset vector
or service interrupt
CPU
Main OSC
Peripherals
I[1:0] bits
On
Off
XX(4)
On
CPU
Main OSC
Peripherals
I[1:0] bits
On
XX(4)
On
64 CPU clock
delay
Watchdog
Enable
Disable
WDGHALT(1)
0
Watchdog
reset
1
cycle
AWU RC OSC
On
AWU RC OSC
Off
AWU RC OSC
Off
HALT instruction
(active halt disabled)
(AWUCSR.AWUEN=1)
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