參數(shù)資料
型號： ST7FLCD1
廠商： 意法半導(dǎo)體
英文描述： 8-bit MCU for LCD Monitors with 60 KBytes Flash, 2 KBytes RAM, 2 DDC Ports and Infrared Controller
中文描述： 8位微控制器的液晶顯示器為60千字節(jié)閃存，2千字節(jié)RAM，2個DDC的港口和紅外線控制器
文件頁數(shù)： 23/95頁
文件大小： 633K
代理商： ST7FLCD1
23/95
ST7FLCD1
Reset
3.2
Watchdog or Illegal Opcode Access Reset
For more information about the Watchdog, please refer to
Section 12: Watchdog Timer (WDG)
An Illegal Opcode reset occurs if the MCU attempts to execute a code that does not match a valid
ST7 instruction.
3.3
External Reset
The external reset is an active low input signal applied to the RESET pin of the MCU.
As shown in
Figure 9
, the RESET signal must remain low for a minimum of 1 μs.
An internal Schmitt trigger and filter provided at the RESET pin improve noise immunity.
3.4
Reset Procedure
At power-up, the MCU follows the sequence described in
Figure 9
.
Note:
Refer to Electrical Characteristics for values of t
DDR
, t
OXOV
, V
TRH
, V
TRL
and V
TRM
.
Figure 8: Reset Generation Diagram
Figure 9: Reset Timing Diagram
Low Voltage Detector
Reset
RESLVD
V
DD
RESET
Watchdog
Illegal Opcode Access
External Reset
V
DD
OSCIN
f
CPU
FFFF
FFFE
PC
RESET
Watchdog Reset
t
DDR
t
OXOV
4096 CPU
Clock Cycle
Delay
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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