參數(shù)資料
型號： ST72F324B
廠商： 意法半導(dǎo)體
英文描述： 5V Range 8-Bit MCU With 8 TO 32K FLASH/ROM, 10-Bit ADC, 4 Timers, SPI, SCI Interface(具有ICP,IAP,Nested Interrupt,TLI,ROP的8位MCU)
中文描述： 5V范圍內(nèi)的8位8到32K閃存/ ROM，10位ADC，4個計時器，SPI和SCI接口（具有比較方案，國際檢察官聯(lián)合會，嵌套中斷，中華語文研習(xí)所，人事登記的8位微控制器）
文件頁數(shù)： 143/167頁
文件大?。?/td> 1641K
代理商： ST72F324B
ST72324B
143/167
12.13 10-BIT ADC CHARACTERISTICS
Subject to general operating conditions for V
DD
, f
CPU
, and T
A
unless otherwise specified.
Notes:
1. Any added external serial resistor will downgrade the ADC accuracy (especially for resistance greater than 10k
). Data
based on characterization results, not tested in production.
Symbol
f
ADC
V
AREF
V
AIN
Parameter
Conditions
Min
0.4
3.8
V
SSA
Typ
Max
2
V
DD
V
AREF
±250
±1
Unit
MHz
ADC clock frequency
Analog reference voltage
Conversion voltage range
1)
0.7*V
DD
≤
V
AREF
≤
V
DD
V
I
lkg
Positive input leakage current for analog
input
-40°C
≤
T
A
≤+
85°C
+85°C
≤
T
A
≤+
125°C
V
IN
<
V
SS,
| I
IN
|< 400μA
on adjacent robust ana-
log pin
nA
μ
A
Negative input leakage current on ro-
bust analog pins
5
6
μ
A
R
AIN
C
AIN
External input impedance
External capacitor on analog input
see
Figure 80
and
Figure
81
2)3)4)
k
pF
f
AIN
Variation freq. of analog input signal
Hz
C
ADC
Internal sample and hold capacitor
Conversion time (Sample+Hold)
f
CPU
=8MHz, SPEED=0 f
ADC
=2MHz
- No of sample capacitor loading cycles
- No. of Hold conversion cycles
12
pF
t
ADC
7.5
μ
s
t
ADC
4
11
1/f
ADC
1
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PDF描述
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