參數(shù)資料
型號： SPAKD56366PV120
廠商： MOTOROLA INC
元件分類： 數(shù)字信號處理
英文描述： 24-BIT, 120 MHz, OTHER DSP, PQFP144
封裝： TQFP-144
文件頁數(shù)： 119/147頁
文件大?。?/td> 2156K
代理商： SPAKD56366PV120
Specifications
Parallel Host Interface (HDI08) Timing
MOTOROLA
DSP56366 Advance Information
2-43
Figure 2-20 Host Interrupt Vector Register (IVR) Read Timing Diagram
Notes:
1.
See Host Port Usage Considerations in the DSP56366 User’s Manual.
2.
In the timing diagrams below, the controls pins are drawn as active low. The pin polarity is
programmable.
3.
VCC = 3.3 V ± 0.16 V; TJ = –40°C to +105°C, CL = 50 pF
4.
The read data strobe is HRD in the dual data strobe mode and HDS in the single data strobe
mode.
5.
The “l(fā)ast data register” is the register at address $7, which is the last location to be read or
written in data transfers.
6.
This timing is applicable only if a read from the “l(fā)ast data register” is followed by a read
from the RXL, RXM, or RXH registers without first polling RXDF or HREQ bits, or waiting
for the assertion of the HOREQ signal.
7.
This timing is applicable only if two consecutive reads from one of these registers are
executed.
8.
The write data strobe is HWR in the dual data strobe mode and HDS in the single data strobe
mode.
9.
The data strobe is host read (HRD) or host write (HWR) in the dual data strobe mode and
host data strobe (HDS) in the single data strobe mode.
10. The host request is HOREQ in the single host request mode and HRRQ and HTRQ in the
double host request mode.
11. In this calculation, the host request signal is pulled up by a 4.7 k
resistor in the open-drain
mode.
Table 2-18 Host Interface (HDI08) Timing1, 2 (Continued)
No.
Characteristics3
Expression
120 MHz
Unit
Min Max
HACK
HD7–HD0
HOREQ
329
317
318
328
326
327
AA1105
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