參數(shù)資料
型號(hào)： SPAKD56366PV120
廠商： MOTOROLA INC
元件分類(lèi)： 數(shù)字信號(hào)處理
英文描述： 24-BIT, 120 MHz, OTHER DSP, PQFP144
封裝： TQFP-144
文件頁(yè)數(shù)： 108/147頁(yè)
文件大?。?/td> 2156K
代理商： SPAKD56366PV120
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Specifications
External Memory Expansion Port (Port A)
MOTOROLA
DSP56366 Advance Information
2-33
Table 2-15 DRAM Out-of-Page and Refresh Timings, Eleven Wait States1, 2
No.
Characteristics4
Symbol
Expression3
Min
Max
Unit
157 Random read or write cycle time
tRC
12
× TC
120.0
—
ns
158 RAS assertion to data valid (read)
tRAC
6.25
× TC 7.0
—
55.5
ns
159 CAS assertion to data valid (read)
tCAC
3.75
× TC 7.0
—
30.5
ns
160 Column address valid to data valid (read)
tAA
4.5
× TC 7.0
—
38.0
ns
161 CAS deassertion to data not valid (read hold time)
tOFF
0.0
—
ns
162 RAS deassertion to RAS assertion
tRP
4.25
× TC 4.0
38.5
—
ns
163 RAS assertion pulse width
tRAS
7.75
× TC 4.0
73.5
—
ns
164 CAS assertion to RAS deassertion
tRSH
5.25
× TC 4.0
48.5
—
ns
165 RAS assertion to CAS deassertion
tCSH
6.25
× TC 4.0
58.5
—
ns
166 CAS assertion pulse width
tCAS
3.75
× TC 4.0
33.5
—
ns
167 RAS assertion to CAS assertion
tRCD
2.5
× TC ± 4.0
21.0
29.0
ns
168 RAS assertion to column address valid
tRAD
1.75
× TC ± 4.0
13.5
21.5
ns
169 CAS deassertion to RAS assertion
tCRP
5.75
× TC 4.0
53.5
—
ns
170 CAS deassertion pulse width
tCP
4.25
× TC 4.0
38.5
—
ns
171 Row address valid to RAS assertion
tASR
4.25
× TC 4.0
38.5
—
ns
172 RAS assertion to row address not valid
tRAH
1.75
× TC 4.0
13.5
—
ns
173 Column address valid to CAS assertion
tASC
0.75
× TC 4.0
3.5
—
ns
174 CAS assertion to column address not valid
tCAH
5.25
× TC 4.0
48.5
—
ns
175 RAS assertion to column address not valid
tAR
7.75
× TC 4.0
73.5
—
ns
176 Column address valid to RAS deassertion
tRAL
6
× TC 4.0
56.0
—
ns
177 WR deassertion to CAS assertion
tRCS
3.0
× TC 4.0
26.0
—
ns
178 CAS deassertion to WR5 assertion
tRCH
1.75
× TC 4.0
13.5
—
ns
179 RAS deassertion to WR5 assertion
tRRH
0.25
× TC 2.0
0.5
—
ns
180 CAS assertion to WR deassertion
tWCH
5
× TC 4.2
45.8
—
ns
181 RAS assertion to WR deassertion
tWCR
7.5
× TC 4.2
70.8
—
ns
182 WR assertion pulse width
tWP
11.5
× TC 4.5
110.5
—
ns
183 WR assertion to RAS deassertion
tRWL
11.75
× TC 4.3
113.2
—
ns
184 WR assertion to CAS deassertion
tCWL
10.25
× TC 4.3
103.2
—
ns
185 Data valid to CAS assertion (write)
tDS
5.75
× TC 4.0
53.5
—
ns
186 CAS assertion to data not valid (write)
tDH
5.25
× TC 4.0
48.5
—
ns
187 RAS assertion to data not valid (write)
tDHR
7.75
× TC 4.0
73.5
—
ns
188 WR assertion to CAS assertion
tWCS
6.5
× TC 4.3
60.7
—
ns
189 CAS assertion to RAS assertion (refresh)
tCSR
1.5
× TC 4.0
11.0
—
ns
190 RAS deassertion to CAS assertion (refresh)
tRPC
2.75
× TC 4.0
23.5
—
ns
191 RD assertion to RAS deassertion
tROH
11.5
× TC 4.0
111.0
—
ns
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PDF描述
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