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參數(shù)資料
| 型號(hào)： | SAA7392HL |
| 廠(chǎng)商： | NXP SEMICONDUCTORS |
| 元件分類(lèi)： | 消費(fèi)家電 |
| 英文描述： | Channel encoder/decoder CDR60 |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP80 |
| 封裝： | 12 X 12 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-315-1, LQFP-80 |
| 文件頁(yè)數(shù)： | 67/76頁(yè) |
| 文件大?。?/td> | 246K |
| 代理商： | SAA7392HL |
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2000 Mar 21
67
Philips Semiconductors
Preliminary specification
Channel encoder/decoder CDR60
SAA7392
9.1
ADC and AGC parameters
Table 156
ADC parameters
Table 157
AGC parameters
PARAMETER
VALUE
COMMENTS
Resolution
Data format
Maximum sample
frequency
SINAD
DNL
INL
Power dissipation
Input range
Voltage reference
Bias current
Bandwidth
Clock frequency
Clock duty cycle
Clock jitter
8-bit
Simple Binary
70 MS/s
nominal rate 50 MS/s
>26 dB
1.0/+1.0 LSB
2.0/+2.0 LSB
<100 mW
1.47
2.91 V
2.9 V
100
μ
A
35 MHz
70 MHz
40 to 60%
±
200 ps
17.5 MHz signal
12 dB down on ADC full scale, 70 MS/s sample rate
70 MS/s; 1 MHz input
70 MS/s; 1 MHz input
top ladder reference
provided externally
3 dB (
0.5 effective bits)
defines sample rate
for 6.5-bit accuracy, f = 17.5 MHz
PARAMETER
VALUE
COMMENTS
Output level
Gain range
Gain step
Bandwidth
Phase linearity
Resolution
SNR
THD
Input range
Input impedance
Offset voltage
1.4 V(p-p)
2.69 to +11.25 dB
1.1 dB
35 MHz
0.6 ns
5-bit
50 dB
<
35 dB
0.39 to 1.96 V
7.57 k
<30 mV
approx. linear in dBs
3 dB point
in bandwidth of 35 MHz
in bandwidth of 35 MHz
f = 17.5 MHz; V
out(p-p)
= 1.44 V; ADC load
peak-to-peak value
nominal, at HIN
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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