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參數(shù)資料
| 型號： | SAA7392HL |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | Channel encoder/decoder CDR60 |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP80 |
| 封裝： | 12 X 12 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-315-1, LQFP-80 |
| 文件頁數(shù)： | 15/76頁 |
| 文件大?。?/td> | 246K |
| 代理商： | SAA7392HL |
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2000 Mar 21
15
Philips Semiconductors
Preliminary specification
Channel encoder/decoder CDR60
SAA7392
7.2.6
I
NTERRUPT
E
NABLE
R
EGISTER
2 (I
NT
E
N
2)
Table 13
Interrupt Enable Register 2 (address 21H) - WRITE
Table 14
Description of IntEn2 bits
7.2.7
S
OFT
R
ESET
R
EGISTER
(S
OFT
R
ESET
)
Table 15
Soft Reset Register (address 1BH) - WRITE
Table 16
Description of SoftReset bits
7
6
5
4
3
2
1
0
BankSwitch
En
SyncErrorEn
DataNotValid
En
QSyncEn
ATIPSyncEn
LaserOnEn
LaserOffEn
XErrorLarge
En
BIT
SYMBOL
DESCRIPTION
7
BankSwitch
En
SyncErrorEn If SyncErrorEn = 1, then SyncError interrupt is enabled.
DataNotVali
dEn
QSyncEn
If QSyncEn = 1, then QSync interrupt is enabled.
ATIPSyncEn If ATIPSyncEn = 1, then ATIPSync interrupt is enabled.
LaserOnEn
If LaserOnEn = 1, then LaserOn interrupt is enabled.
LaserOffEn
If LaserOffEn = 1, then LaserOff interrupt is enabled.
XErrorLarge
En
If BankSwitchEn = 1, then BankSwitch interrupt is enabled.
6
5
If DataNotValidEn = 1, then DataNotValid interrupt is enabled.
4
3
2
1
0
If XerrorLarge = 1, then XErrorLarge interrupt is enabled.
7
6
5
4
3
2
1
0
SReset1
BIT
SYMBOL
SReset1
DESCRIPTION
7 to 1
0
These 7 bits are reserved.
When set, synchronisation with PLUM on subcode transfer has failed; reset when
a logic 1 is written to this bit (Status2).
This bit is an active HIGH reset to the following blocks: Encoder/decoder, EFM
modulator, Encode control block, Serial input/output block and Encode subcode insert
block. The clock control, EFM PLL, tacho, motor interface and wobble interface remain
running.
Soft reset will reset the following registers: EFMPresetCount, EFMModulateConfig,
EFMModulateConfig2, EncodeXOffset, EncodeWriteControl, EncodeStartOffset,
EncodeStopOffset, SubPresetCount, SubConfig1, Subconfig2, SubStartData, SubData,
InputConfig, DecoMode, Output1, Output2 and Output3.
A soft reset is mandatory in the following cases:
1.
After programming the BCLK clock
2.
When switching from encode to decode
3.
When switching from decode to encode.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAA7392 | Channel encoder/decoder CDR60(通道編碼器/譯碼器) |
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參數(shù)描述 |
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