參數(shù)資料
型號(hào)： PC8245
廠(chǎng)商： Atmel Corp.
英文描述： Integrated Processor Family
中文描述： 綜合處理器系列
文件頁(yè)數(shù)： 41/61頁(yè)
文件大小： 429K
代理商： PC8245
41
PC8245
2171D–HIREL–06/04
Figure 23.
EPIC Serial Interrupt Mode Input Timing Diagram
IEEE 1149.1 (JTAG) AC Timing
Specifications
Table 15 provides the JTAG AC timing specifications for the PC8245 while in the JTAG
operating mode at recommended operating conditions (see Table “Recommended
Operating Conditions” on page 12) with L
V
DD
= 3.3V ± 0.3V. Timings are independent of
the system clock (PCI_SYNC_IN).
Notes:
1. TRST is an asynchronous signal. The setup time is for test purposes only.
2. Nontest (other than TDI and TMS) signal input timing with respect to TCK.
3. Nontest (other than TDO) signal output timing with respect to TCK.
Figure 24.
JTAG Clock Input Timing Diagram
6
S_CLK
S_INT
7
VM
Table 15.
JTAG AC Timing Specifications (Independent of PCI_SYNC_IN)
Number
Characteristics
Min
Max
Unit
Notes
TCK Frequency of Operation
0
25
MHz
1
TCK Cycle Time
40
–
ns
2
TCK Clock Pulse Width Measured at 1.5V
20
–
ns
3
TCK Rise and Fall Times
0
3
ns
4
TRST Setup Time to TCK Falling Edge
10
–
ns
(1)
5
TRST Assert Time
10
–
ns
6
Input Data Setup Time
5
–
ns
(2)
7
Input Data Hold Time
15
–
ns
(2)
8
TCK to Output Data Valid
0
30
ns
(3)
9
TCK to Output High Impedance
0
30
ns
(3)
10
TMS, TDI Data Setup Time
5
–
ns
11
TMS, TDI Data Hold Time
15
–
ns
12
TCK to TDO Data Valid
0
15
ns
13
TCK to TDO High Impedance
0
15
ns
TCK
2
2
1
VM
VM
VM
3
3
VM = Midpoint Voltage
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PDF描述
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