參數(shù)資料
型號： PC8245
廠商： Atmel Corp.
英文描述： Integrated Processor Family
中文描述： 綜合處理器系列
文件頁數(shù)： 32/61頁
文件大?。?/td> 429K
代理商： PC8245
32
PC8245
2171D–HIREL–06/04
Figure 13.
Input
–
Output Timing Diagram Referenced to SDRAM_SYNC_IN
Notes:
VM = midpoint voltage (1.4V).
11a = input hold time of SDRAM_SYNC_IN to memory.
12b-d = SDRAM_SYNC_IN to output valid timing.
13b = output hold time for non-PCI signals.
14b = SDRAM-SYNC_IN to output high-impedance timing for non-PCI signals.
Tos = offset timing required to align sys_logic_clk with SDRAM_SYNC_IN. The SDRAM_SYNC_IN signal is adjusted by
the DLL to accommodate for internal delay. This causes SDRAM_SYNC_IN to be seen before sys_logic_clk once the DLL
locks, if no other accommodation is made for the delay.
10b-d = input signals valid timing.
Figure 14.
Input
–
Output Timing Diagram Referenced to PCI_SYNC_IN
11a
Memory
10b-d
Inputs/Outputs
13b
14b
VM
VM
SDRAM_SYNC_IN
(After DLL Locks
if no compensation
for T
os
is made)
Input Timing
Output Timing
12b-d
2.0 V
0.8 V
0.8 V
2.0 V
T
os
sys_logic_clk
VM
PCI_SYNC_IN
VM
VM
Shown in 2:1 Mode
OVdd/2
10a
11c
PCI_SYNC_IN
PCI
12a
13a
14a
OVdd/2
OVdd/2
0.4*OVdd
0.615*OVdd
0.285*OVdd
Input Timing
Output Timing
INPUTS/OUTPUTS
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PDF描述
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