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參數(shù)資料
| 型號： | MT47H128M8HQ-187ELAT:E |
| 元件分類： | DRAM |
| 英文描述： | 128M X 8 DDR DRAM, 0.35 ns, PBGA60 |
| 封裝： | 8 X 11.50 MM, ROHS COMPLIANT, FBGA-60 |
| 文件頁數(shù)： | 88/133頁 |
| 文件大?。?/td> | 9170K |
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Table 29: DDR2-667/800/1066 Setup and Hold Time Derating Values (tIS and tIH)
Command/
Address Slew
Rate (V/ns)
CK, CK# Differential Slew Rate
Units
2.0 V/ns
1.5 V/ns
1.0 V/ns
ΔtIS
ΔtIH
ΔtIS
ΔtIH
ΔtIS
ΔtIH
4.0
+150
+94
+180
+124
+210
+154
ps
3.5
+143
+89
+173
+119
+203
+149
ps
3.0
+133
+83
+163
+113
+193
+143
ps
2.5
+120
+75
+150
+105
+180
+135
ps
2.0
+100
+45
+160
+75
+160
+105
ps
1.5
+67
+21
+97
+51
+127
+81
ps
1.0
0
+30
+60
ps
0.9
–5
–14
+25
+16
+55
+46
ps
0.8
–13
–31
+17
–1
+47
+29
ps
0.7
–22
–54
+8
–24
+38
+6
ps
0.6
–34
–83
–4
–53
+36
–23
ps
0.5
–60
–125
–30
–95
0
–65
ps
0.4
–100
–188
–70
–158
–40
–128
ps
0.3
–168
–292
–138
–262
–108
–232
ps
0.25
–200
–375
–170
–345
–140
–315
ps
0.2
–325
–500
–295
–470
–265
–440
ps
0.15
–517
–708
–487
–678
–457
–648
ps
0.1
–1,000
–1,125
–970
–1,095
–940
–1,065
ps
1Gb: x4, x8, x16 DDR2 SDRAM
Input Slew Rate Derating
PDF: 09005aef821ae8bf
1GbDDR2.pdf – Rev. S 10/09 EN
58
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相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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