參數(shù)資料
型號(hào)： MPC509
廠商： MOTOROLA INC
元件分類(lèi)： 微控制器/微處理器
英文描述： Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述： 32-BIT, RISC MICROCONTROLLER, PQFP16
文件頁(yè)數(shù)： 91/300頁(yè)
文件大?。?/td> 3744K
代理商： MPC509
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MPC509
USER’S MANUAL
INSTRUCTION CACHE
Rev. 15 June 98
MOTOROLA
4-5
4.4 Cache Operation
On an instruction fetch, bits 21:27 of the instruction’s address are used as an index
into the cache to retrieve the tags and data of one set. The tags from both accessed
lines are then compared to bits 0:20 of the instruction’s address. If a match is found
and the matched entry is valid, then the access is a cache hit.
If neither tag matches or if the matched tag is not valid, the access is a cache miss.
The I-cache includes one burst buffer that holds the last line received from the bus,
and one line buffer that holds the last line received from the cache array. If the
requested data is found in one of these buffers, the access is considered a cache hit.
To minimize power consumption, the I-cache attempts to make use of data stored in
one of its internal buffers. Using a special indication from the CPU, it is also possible,
in some cases, to detect that the requested data is in one of the buffers early enough
so the cache array is not activated at all.
4.4.1 Cache Hit
On a cache hit, bits 28:29 of the instruction’s address are used to select one word from
the cache line whose tag matched. In the same clock cycle, the instruction is trans-
ferred to the instruction unit of the processor.
4.4.2 Cache Miss
On a cache miss, the address of the missed instruction is driven on the I-bus with a
four-word burst transfer read request. A cache line is then selected to receive the data
that will be coming from the bus. The selection algorithm gives first priority to invalid
lines. If neither of the two candidate lines in the selected set are invalid, then the least
recently used line is selected for replacement. Locked lines are never replaced.
Table 4-3 I-Cache Address Register (ICADR)
Bits
Mnemonic
Description
0:31
ADR
The address to be used in the command programmed in the control and status
register
ICSDAT
— I-Cache Data Register
SPR 562
0
1
2
3
4
5
6
7
8
9
10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31
DAT
RESET:
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Table 4-4 I-Cache Data Register (ICDAT)
Bits
0:31
Mnemonic
Description
DAT
The data received when reading information from the I-cache
相關(guān)PDF資料
PDF描述
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MPC555 Highly Integrated, Low-Power, 32-Bit Microcontroller
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參數(shù)描述
MPC509A 制造商:BB 制造商全稱(chēng):BB 功能描述:Single-Ended 8-Channel/Differential 4-Channel CMOS ANALOG MULTIPLEXERS
MPC509AP 功能描述:多路器開(kāi)關(guān) IC 4-Ch Diff-Input Analog Mult RoHS:否 制造商:Texas Instruments 通道數(shù)量:1 開(kāi)關(guān)數(shù)量:4 開(kāi)啟電阻（最大值）:7 Ohms 開(kāi)啟時(shí)間（最大值）: 關(guān)閉時(shí)間（最大值）: 傳播延遲時(shí)間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:UQFN-16
MPC509AP 制造商:BURR-BROWN 功能描述:IC MUX 4CH DP DIP28 509 制造商:Texas Instruments 功能描述:Multiplexer IC Multiplexer Type:Differen
MPC509APG4 功能描述:多路器開(kāi)關(guān) IC 4Ch Diff-Input Ana Multiplexer RoHS:否 制造商:Texas Instruments 通道數(shù)量:1 開(kāi)關(guān)數(shù)量:4 開(kāi)啟電阻（最大值）:7 Ohms 開(kāi)啟時(shí)間（最大值）: 關(guān)閉時(shí)間（最大值）: 傳播延遲時(shí)間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:UQFN-16
MPC509AU 功能描述:多路器開(kāi)關(guān) IC 4-Ch Diff-Input Analog Mult RoHS:否 制造商:Texas Instruments 通道數(shù)量:1 開(kāi)關(guān)數(shù)量:4 開(kāi)啟電阻（最大值）:7 Ohms 開(kāi)啟時(shí)間（最大值）: 關(guān)閉時(shí)間（最大值）: 傳播延遲時(shí)間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:UQFN-16
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