參數(shù)資料
型號： MPC509
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述： 32-BIT, RISC MICROCONTROLLER, PQFP16
文件頁數(shù)： 114/300頁
文件大?。?/td> 3744K
代理商： MPC509
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MOTOROLA
5-20
SYSTEM INTERFACE UNIT
Rev. 15 June 98
MPC509
USER’S MANUAL
5.4.5 Bus Cycle Phases
The following paragraphs describe the three bus cycle phases: arbitration phase,
address phase, and data phase. Note that there is no separate arbitration for the
address and data buses.
5.4.5.1 Arbitration Phase
The SIU supports multiple masters but is optimized for single-master systems. Each
master must have bus request, bus grant, and bus busy signals. Arbitration signals of
the masters feed into a central arbiter for arbitration.
Before the SIU can start an external cycle, it must have a qualified bus grant. A quali-
fied bus grant occurs when the external arbiter asserts BG (bus grant) and the
previous bus master negates BB (the bidirectional bus busy signal). This means that
no other master is currently running a cycle on the external bus. If the SIU is ready to
start an external cycle and it does not have a qualified bus grant, then it asserts BR
(bus request) until it receives the qualified bus grant. Once the SIU receives a qualified
bus grant, it asserts BB and begins the address phase of the cycle.
A word-aligned access to a 16-bit port results in two bus cycles. To preserve word
coherency, the SIU does not release the bus between these two cycles.
The external arbiter can park the bus by keeping BG asserted. Single-master systems
should tie this signal low permanently, or configure the pin as a port pin, which has the
same effect. Each potential master has its own BG input signal.
5.4.5.2 Address Phase
Once the SIU has a qualified bus grant, it asserts BB and starts an address phase. The
SIU drives a new address at the start of the address phase and maintains it on the pins
throughout the address phase.
The signals shown in
Table 5-8
are driven at the start of the address phase.
TS is a control signal that is valid for only one clock cycle at the start of the address
phase. The address attributes listed in
Table 5-8
are updated at the start of the
address phase and are maintained until the start of the next address phase.
Table 5-8 Signals Driven at Start of Address Phase
Mnemonic
ADDR[0:29]
TS
WR
BE[0:3]
AT[0:1]
CT[0:3]
BURST
Signal Name
Address bus
Transfer start
Write/read
Byte enables
Address type
Cycle type
Burst
Type
Address bus
Control
Address attribute
Address attribute
Address attribute
Address attribute
Address attribute
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PDF描述
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MPC509AU 功能描述:多路器開關(guān) IC 4-Ch Diff-Input Analog Mult RoHS:否 制造商:Texas Instruments 通道數(shù)量:1 開關(guān)數(shù)量:4 開啟電阻（最大值）:7 Ohms 開啟時(shí)間（最大值）: 關(guān)閉時(shí)間（最大值）: 傳播延遲時(shí)間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:UQFN-16
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